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      設(shè)計(jì)/布局的關(guān)鍵測試陷阱-Design/Layout Pit

      2009-11-20 | rar | 555 | 次下載 | 免費(fèi)

      資料介紹

      設(shè)計(jì)/測試重點(diǎn)布局的陷阱-Design/Layout Pitfalls Test Key

      正常chip,與test key的die size, PE 建議兩者需一致.
      Case Study.兩者大小不一,會造成PE部門在 CP 時(shí)alignment下半部出問題.
      兩層光罩的零點(diǎn)需一致.
      Case study.只修改一層mask時(shí)

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