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開發(fā)下一代DSP硬件平臺(tái)的挑戰(zhàn)
包括數(shù)字信號(hào)處理(DSP)在內(nèi)的下一代產(chǎn)品，需要提高性能和靈活性，同時(shí)縮短開發(fā)周期，降低成本與功耗。FPGA的靈活性能實(shí)現(xiàn)高度并行性，即便最嚴(yán)苛的性能要求也可以滿足。由于FPGA的應(yīng)用超越了傳統(tǒng)的硬件設(shè)計(jì)社區(qū)，因此挑戰(zhàn)就是在不危及緊迫工期的情況下充分利用這些優(yōu)勢(shì)。
包括數(shù)字信號(hào)處理(DSP)在內(nèi)的下一代產(chǎn)品，需要提高性能和靈活性，同時(shí)縮短開發(fā)周期，降低成本與功耗。FPGA的靈活性能實(shí)現(xiàn)高度并行性，即便最嚴(yán)苛的性能要求也可以滿足。由于FPGA的應(yīng)用超越了傳統(tǒng)的硬件設(shè)計(jì)社區(qū)，因此挑戰(zhàn)就是在不危及緊迫工期的情況下充分利用這些優(yōu)勢(shì)。
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