AD學(xué)習(xí)問題記錄(二):pcb設(shè)計(jì)規(guī)則檢查報(bào)錯(cuò)Silk To Solder Mask Clearance Constraint
2021-12-04 |
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資料介紹
AD pcb設(shè)計(jì)規(guī)則檢查報(bào)錯(cuò)Silk To Solder Mask Clearance Constraint報(bào)錯(cuò)原因處理方法一:改變規(guī)則中的最小間距:方法二:直接取消這一項(xiàng)的檢查:結(jié)果軟件版本Altium Designer (21.2.0)報(bào)錯(cuò)pcb設(shè)計(jì)規(guī)則檢查報(bào)錯(cuò)Silk To Solder Mask Clearance Constraint,如圖:原因還是絲印的距離問題,使用被人的封裝但是和自己的“設(shè)計(jì)規(guī)則檢查”有沖突。可以自己根據(jù)“規(guī)則”畫封裝,也可以更改“設(shè)計(jì)規(guī)則”。處理自己畫封裝還
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