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      電子發(fā)燒友網(wǎng)>電子資料下載>IC datasheet pdf>SN54ABT16853, SN74ABT16853,pdf

      SN54ABT16853, SN74ABT16853,pdf

      2010-07-20 | rar | 335 | 次下載 | 2積分

      資料介紹

      The 'ABT16853 dual 8-bit to 9-bit parity transceivers are designed for communication between data buses. When data is transmitted from the A bus to the B bus, a parity bit is generated. When data is transmitted from the B bus to the A bus, with its corresponding parity bit, the open-collector parity-error () output indicates whether or not an error in the B data has occurred. The output-enable (and ) inputs can be used to disable the device so that the buses are effectively isolated. The 'ABT16853 provide true data at the outputs.

      A 9-bit parity generator/checker generates a parity-odd (PARITY) output and monitors the parity of the I/O ports with the flag. The parity-error output can be passed, sampled, stored, or cleared from the latch using the latch-enable () and clear () control inputs.

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