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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>DDR(雙速率)SDRAM控制器參考設(shè)計(jì)

      DDR(雙速率)SDRAM控制器參考設(shè)計(jì)

      2009-05-14 | rar | 333 | 次下載 | 5積分

      資料介紹

      Contents of xapp253.zip file

      ?????? contains verilog source files
      ?????? *top.v* is the source file for DDR SDRAM controller
      ?????? *tb_top.v* is the source file for testbench
      ?????? *define.v* contains variable definitions
      ?????? *mt46v4m16.v* is the simulation model of 64MB DDR SDRAM from Micron

      *top.ucf* is the user constraint file to be specified during
      ??????? Place and Route. This contains the constraints for 133MHz implementation

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