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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>ZBT SRAM Controller Reference

      ZBT SRAM Controller Reference

      2009-06-14 | rar | 233 | 次下載 | 3積分

      資料介紹

      ZBT SRAM Controller Reference Design for APEX II Devices

      As communication systems require more low-latency, high-bandwidth
      interfaces for peripheral components, designs need high-throughput
      memory with efficient bus utilization. The previous generation of static
      memory types are inefficient when they frequently switch between
      reading from and writing to the memory. To address this problem, IDT,
      Micron, and Motorola have developed the new zero-bus turnaround
      (ZBT) SRAM architecture. To implement this new memory, Altera has
      developed a ZBT SRAM controller reference design for use with
      APEXTM II devices.
      This application note describes the functionality of the Altera? ZBT
      SRAM controller reference design and explains the data tree structure,
      along with installation, compilation, and simulation, of the design file.

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