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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>選擇適合您FPGA系統(tǒng)的I/O體系結(jié)構(gòu)

      選擇適合您FPGA系統(tǒng)的I/O體系結(jié)構(gòu)

      2009-11-20 | rar | 344 | 次下載 | 5積分

      資料介紹

      選擇適合您FPGA系統(tǒng)的I/O體系結(jié)構(gòu):即使在幾年前, 設(shè)計(jì)師還主要是把FPGA作為設(shè)計(jì)原型的工具。但隨著近十年來(lái)FPGA 數(shù)據(jù)速率的迅速提高, 現(xiàn)在已完全能與CMOS ASIC相匹敵。系統(tǒng)性能的急速提升使設(shè)計(jì)人員能在更多的領(lǐng)域利用FPGA的靈活性優(yōu)勢(shì), 為通信、計(jì)算機(jī)、消費(fèi)類電子、工控、汽車電子、航空航天和軍事等眾多領(lǐng)域提供易于升級(jí)的產(chǎn)品解決方案。最新FPGA 處理速度的提高甚至可以允許設(shè)計(jì)人員能夠靈活地創(chuàng)建自己的、針對(duì)應(yīng)用的高速總線。應(yīng)用指南 1500然而，這些設(shè)計(jì)師隨即必須面對(duì)高速I/O 的挑戰(zhàn)。通道間時(shí)滯、抖動(dòng)以及數(shù)據(jù)窗口大小等因素都限制了FPGA 的實(shí)際數(shù)據(jù)速率要低于理論值。針對(duì)這些問(wèn)題, FPGA 系統(tǒng)設(shè)計(jì)人員延續(xù)過(guò)去在ASIC 上的做法,采用能減少這些影響因素的I/O 體系結(jié)構(gòu)。這篇應(yīng)用指南介紹今天最流行的I/O 體系結(jié)構(gòu), 和會(huì)使各種體系結(jié)構(gòu)I/O性能變差的因素。最后還將介紹如何針對(duì)您的應(yīng)用選擇最合適的I/O 體系結(jié)構(gòu)。
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