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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>基于FPGA的正碼速調(diào)整的設(shè)計(jì)與實(shí)現(xiàn)

      基于FPGA的正碼速調(diào)整的設(shè)計(jì)與實(shí)現(xiàn)

      2010-01-13 | rar | 221 | 次下載 | 5積分

      資料介紹

      本文提出了基于FPGA 正碼速調(diào)整的設(shè)計(jì)方案，采用格雷碼對(duì)地址編碼的異步FIFO
      設(shè)計(jì)，并利用MAXPLUSⅡ進(jìn)行編譯和仿真。結(jié)果表明，設(shè)計(jì)方法切實(shí)可行。
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