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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>在軟件無線電調(diào)制解調(diào)器功能中使用硬件加速單元

      在軟件無線電調(diào)制解調(diào)器功能中使用硬件加速單元

      2010-07-17 | rar | 122 | 次下載 | 3積分

      資料介紹

      現(xiàn)場可編程門陣列（FPGA）已經(jīng)不再單純應(yīng)用在芯片與系統(tǒng)之間的直接互聯(lián)層，在軟件無線電（SDR）中，F(xiàn)PGA逐漸用做通用運算架構(gòu)來實現(xiàn)硬件加速單元，在降低成本和功耗的基礎(chǔ)上提升性能表現(xiàn)。SDR調(diào)制解調(diào)器的典型實現(xiàn)包括通用處理器（GPP）、數(shù)字信號處理器（DSP）和FPGA。而且，F(xiàn)PGA架構(gòu)可以結(jié)合專用硬件加速單元，用來卸載GPP或DSP。軟核微處理器可以結(jié)合定制邏輯，擴展其內(nèi)核，也可以將分立的硬件加速協(xié)處理器添加到系統(tǒng)中。此外，還可將通用布線資源放在FPGA中，這些硬件加速單元可以并行運行，進一步增強系統(tǒng)的整體運算輸出能力。本文將討論三種不同類型的硬件加速單元，以及它們通過軟件實現(xiàn)的性能。

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