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      電子發(fā)燒友網>電子資料下載>可編程邏輯>FPGA/ASIC>對Altera 28nm FPGA浮點DSP設計流程和性能的獨立分析

      對Altera 28nm FPGA浮點DSP設計流程和性能的獨立分析

      2012-10-31 | rar | 531.0 KB | 次下載 | 免費

      資料介紹

      　　電子發(fā)燒友網核心提示：Altera公司昨日宣布，在業(yè)界率先在28 nm FPGA器件上成功測試了復數(shù)高性能浮點數(shù)字信號處理（DSP）設計。獨立技術分析公司Berkeley設計技術有限公司（BDTI）驗證了能夠在 Altera Stratix V和Arria V 28 nm FPGA開發(fā)套件上簡單方便的高效實現(xiàn)Altera浮點DSP設計流程，同時驗證了要求較高的浮點DSP應用的性能。本文是BDTI完整的FPGA浮點DSP分析報告。

      　　 Altera的浮點DSP設計流程經過規(guī)劃，能夠快速適應可參數(shù)賦值接口的設計更改，其工作環(huán)境包括來自MathWorks的MATLAB和 Simulink，以及Altera的DSP Builder高級模塊庫，支持FPGA設計人員比傳統(tǒng)HDL設計更迅速的實現(xiàn)并驗證復數(shù)浮點算法。這一設計流程非常適合設計人員在應用中采用高性能 DSP，這些應用包括，雷達、無線基站、工業(yè)自動化、儀表和醫(yī)療圖像等。

      對Altera 28nm FPGA浮點DSP設計流程和性能的獨立分析

      dsp FPGA Stratix Altera Berkeley Arria
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