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      基于FPGA的高速多路數(shù)據(jù)采集系統(tǒng)的設(shè)計方案詳細資料說明

      2018-10-12 | rar | 0.32 MB | 次下載 | 免費

      資料介紹

      　　介紹了一種基于FPGA的高速多路數(shù)據(jù)采集系統(tǒng)的設(shè)計方案，描述了系統(tǒng)的主要組成及FPGA的實現(xiàn)方法，并用v∞L語言設(shè)計的狀態(tài)杌在Qmr嚙Ⅱ開發(fā)軟件中進行仿真。該系統(tǒng)在通用數(shù)據(jù)采集系統(tǒng)的基礎(chǔ)上，增加數(shù)據(jù)編碼模塊，將多路數(shù)據(jù)組合為一路進行存儲；采用批處理數(shù)據(jù)方式，減少數(shù)據(jù)編碼次數(shù)。加快數(shù)據(jù)處理速度。實驗表明，能夠?qū)崟r存儲多路數(shù)據(jù)，效果良好。

      　　存儲模塊是整個采集系統(tǒng)的核心部分，設(shè)計時要根據(jù)存儲容量要求選擇合適的存儲介質(zhì)、存儲芯片。還要從可靠性角度出發(fā)，設(shè)計一些保護電路。方案上力求簡單可靠，以滿足功能要求為目的。

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