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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>如何使用VHDL設(shè)計(jì)一個(gè)簡(jiǎn)易出租車計(jì)費(fèi)器的資料合集免費(fèi)下載

      如何使用VHDL設(shè)計(jì)一個(gè)簡(jiǎn)易出租車計(jì)費(fèi)器的資料合集免費(fèi)下載

      2021-09-01 | rar | 0.60 MB | 次下載 | 免費(fèi)

      資料介紹

      　　本文介紹了一種采用單片FPGA芯片進(jìn)行出租車計(jì)費(fèi)器的設(shè)計(jì)方法，主要闡述如何使用EDA器件取代傳統(tǒng)的電子設(shè)計(jì)方法，利用FPGA的可編程性，簡(jiǎn)潔而又多變的設(shè)計(jì)方法，縮短了研發(fā)周期，同時(shí)使簡(jiǎn)易出租車計(jì)費(fèi)器體積更小功能更強(qiáng)大。本設(shè)計(jì)實(shí)現(xiàn)了出租車計(jì)費(fèi)器所需的一些基本功能，計(jì)費(fèi)包括起步價(jià)、行車?yán)锍逃?jì)費(fèi)，并用數(shù)碼管顯示里程和收費(fèi)金額，同時(shí)考慮到出租車行業(yè)的一些特殊性，更注重了把一些新的思路加入到設(shè)計(jì)中。主要包括采用了FPGA芯片，使用VHDL語(yǔ)言進(jìn)行編程，使其具有了更強(qiáng)的移植性，更加利于產(chǎn)品升級(jí)。

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