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      如何使用FPGA進行高速雷達數(shù)據(jù)采集系統(tǒng)的設(shè)計概述

      2018-12-24 | rar | 0.31 MB | 次下載 | 免費

      資料介紹

      　　高速雷達數(shù)據(jù)采集系統(tǒng)的設(shè)計方法。該系統(tǒng)由FPGA芯片完成各芯片之間的邏輯控制，具有設(shè)計靈活、結(jié)構(gòu)簡單、實時性高、可靠性高等優(yōu)點。

      　　目標(biāo)的識別需要高精度的數(shù)據(jù)，為了得到這些數(shù)據(jù)，必須以更高頻率對回波進行采集。而用于目標(biāo)識別的精確數(shù)據(jù)所使用的采樣頻率通常需要達到36MHz或更高。

      　　系統(tǒng)采用的開窗采集是在目標(biāo)檢測成功完成的前提下進行的。它利用目標(biāo)檢測的結(jié)果，得到目標(biāo)方位和距離信息，然后在下一次雷達掃描中，在該方位和距離上形成脈寬為1斗8的采集波門，利用這一采集波門控制采樣電路模塊，完成一次高采樣頻率、高精度的采集。


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