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本文檔的主要內(nèi)容詳細(xì)介紹的是FPGA視頻教程之Verilog HDL有什么用處詳細(xì)資料說(shuō)明免費(fèi)下載。
Verilog HDL有什么用處？1.在各種抽象層次上描述數(shù)字電路2.測(cè)試各種層次數(shù)字電路的行為3.設(shè)計(jì)出正確有效的復(fù)雜電路結(jié)構(gòu)
Verilog HDL的應(yīng)用方面
1.ASIC和FPGA設(shè)計(jì)師可用它來(lái)編寫(xiě)可綜合的代碼。
2.描述系統(tǒng)的結(jié)構(gòu)，做高層次的仿真。
3.驗(yàn)證工程師編寫(xiě)各種層次的測(cè)試模塊對(duì)具體電路設(shè)計(jì)工程師所設(shè)計(jì)的模塊進(jìn)行全面細(xì)致的驗(yàn)證。
4.庫(kù)模型的設(shè)計(jì)：可以用于描述ASIC和FPGA的基本單元（Cell） 部件，也可以描述復(fù)雜的宏單元（Macro Cell）
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