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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>如何使用CPLD進行PAL制式時序信號發(fā)生與合成的詳細方案資料說明

      如何使用CPLD進行PAL制式時序信號發(fā)生與合成的詳細方案資料說明

      2019-05-24 | rar | 0.59 MB | 次下載 | 免費

      資料介紹

      　　主要講述了PAL制視頻時序信號的產(chǎn)生過程和PAL制彩色電視信號的合成方法，并以此為例介紹了一種低成本視頻時序信號發(fā)生器的實現(xiàn)方案。文中討論的視頻時序信號發(fā)生器以Altera公司MAX II系列的CPLD為核心，只要根據(jù)需要修改CPLD中的信號形成程序，便可應(yīng)用于其他非廣播電視標準的視頻系統(tǒng)當中

      　　在PAL制式的電視系統(tǒng)當中視頻的的時序信號主要包括場同步信號、行同步信號、均衡脈沖、槽脈沖、行消隱信號、場消隱信號，如果用分立元件合成彩色的PAL制式電視信號則還需要P脈沖和K脈沖門。

      　　視頻時序信號可以通過分立的模擬和數(shù)字電路組合產(chǎn)生或者通過一些專用的集成電路來產(chǎn)生。利用分立電路產(chǎn)生時序信號的方法不但電路復雜龐大而且其精度也難以得到保證：目前市面上也有一些可以產(chǎn)生時序信號的集成電路芯片比如Analog Devices 公司的ADV7170、ADV71712］和 National Semiconductor 公司的LM1882等芯片但其只能輸出固定的幾組視頻時序信號，而且支持的視頻標準單一，缺乏靈活性。往往不能滿足視頻系統(tǒng)特別是一些有多個處理單元的視頻系統(tǒng)要求多種形式視頻時序信號輸入的需求。

      　　CPLD編程靈活、精度高且設(shè)計成本低，如果用CPLD來實現(xiàn)視頻同步信號的發(fā)生正好填補了利用分立器件或者專用集成電路精度低、電路復雜和缺乏靈活性等不足。筆者利用本文介紹的方案成功發(fā)生出PAL制式電視信號所需的各路時序信號并成功應(yīng)用于PAL制式彩色電視信號的合成，正好說明了此方案的可行性。

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