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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>Quartus官方的Verilog教程使用FPGA的典型電路設(shè)計(jì)和實(shí)現(xiàn)等資料說明

      Quartus官方的Verilog教程使用FPGA的典型電路設(shè)計(jì)和實(shí)現(xiàn)等資料說明

      2019-09-20 | pdf | 1.46 MB | 次下載 | 5積分

      資料介紹

      　　本教程介紹Quartus Prime CAD系統(tǒng)。本文概述了用fpga器件實(shí)現(xiàn)的典型電路設(shè)計(jì)CAD流程，并說明了該流程是如何在quartus prime軟件中實(shí)現(xiàn)的。通過給出使用quartus prime軟件在intel-fpga設(shè)備中實(shí)現(xiàn)非常簡單的電路的逐步說明，說明了設(shè)計(jì)過程。

      　　quartus prime系統(tǒng)完全支持將所需電路的描述輸入CAD系統(tǒng)的所有常用方法。本教程使用verilog設(shè)計(jì)輸入法，用戶在該方法中使用verilog硬件描述語言指定所需的電路。本教程有三個(gè)版本：一個(gè)版本使用verilog硬件描述語言，另一個(gè)版本使用vhdl硬件描述語言，第三個(gè)版本基于以原理圖的形式定義所需的電路。

      　　設(shè)計(jì)過程的最后一步是在實(shí)際的fpga設(shè)備中配置所設(shè)計(jì)的電路。為了說明這是如何做到的，假設(shè)用戶可以訪問連接到安裝了Quartus Prime軟件的計(jì)算機(jī)的Intel de Series開發(fā)和教育板。沒有de系列板訪問權(quán)限的讀者仍然會(huì)發(fā)現(xiàn)本教程對(duì)于學(xué)習(xí)如何執(zhí)行fpga編程和配置任務(wù)非常有用。

      　　本教程中的屏幕截圖是使用Quartus Prime版本18.0標(biāo)準(zhǔn)版獲得的；其他版本的軟件可能略有不同。

      FPGA Verilog CAD quartus
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