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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>LVDS在FPGA中的使用教程之LVDS傳輸在C4器件上的實(shí)現(xiàn)

      LVDS在FPGA中的使用教程之LVDS傳輸在C4器件上的實(shí)現(xiàn)

      2020-12-30 | rar | 0.43 MB | 次下載 | 免費(fèi)

      資料介紹

      　　LVDS信號(hào)的電壓擺幅只有350MV， 為電流驅(qū)動(dòng)的差分信號(hào)方式工作，最長(zhǎng)的傳輸距離可以達(dá)到10米以上。為了確保信號(hào)在傳輸線當(dāng)中傳播時(shí)，不受反射信號(hào)的影響，LVDS信號(hào)要求傳輸線阻抗受控，其中單線阻抗為50ohms，差分阻抗100ohms。LVDS的工作原理是其中發(fā)送端是一個(gè)為3.5mA的電流源，產(chǎn)生的3.5mA的電流通過差分線中的一路傳到接收端。由于接收端對(duì)直流表現(xiàn)為高阻，電流通過接收端的100R的匹配電阻產(chǎn)生350mV的電壓，同時(shí)電流經(jīng)過差分線的另一條流回發(fā)送端。當(dāng)發(fā)送端狀態(tài)變化時(shí)它通過改變流經(jīng)100R電阻的電流的方向產(chǎn)生有效的‘0’和‘1’狀態(tài)態(tài)。

      　　C4 E器件的左右邊4個(gè)bank支持true LVDS transmitters，上面4個(gè)bank支持emulated LVDS transmitters。

      　　C4 E器件使用true lvds transmitters接收和發(fā)送數(shù)據(jù)時(shí)，連接示意圖如下，在接收時(shí)，端接100R電阻，發(fā)送數(shù)據(jù)時(shí)，不需要端接100R電阻。

      FPGA 電阻 lvds
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