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Cyclone FPGA 具有鎖相環(huán)（PLL）和全局時(shí)鐘網(wǎng)絡(luò)，提供完整的時(shí)鐘管理方案。Cyclone PLL 具有時(shí)鐘倍頻和分頻、相位偏移、可編程 占空比和外部時(shí)鐘輸出，進(jìn)行系統(tǒng)級(jí)的時(shí)鐘管理和偏移控制。Altera? Quartus? II 軟件無(wú)需任何外部器件，就可以啟用Cyclone PLL 和 相關(guān)功能。本文將介紹如何設(shè)計(jì)和使用Cyclone PLL 功能。
PLL 常用于同步內(nèi)部器件時(shí)鐘和外部時(shí)鐘，使內(nèi)部工作的時(shí)鐘頻率比外部時(shí)鐘更高，時(shí)鐘延遲和時(shí)鐘偏移最小，減小或調(diào)整時(shí)鐘到輸出（TCO）和建立（TSU）時(shí)間。
硬件結(jié)構(gòu)
每個(gè) Cyclone FPGA 包括具有多達(dá)兩個(gè)PLL。表1 為種型號(hào)Cyclone FPGA 內(nèi)可用的PLL 數(shù)量。
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