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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>如何實(shí)現(xiàn)兩塊FPGA之間的通信總結(jié)

      如何實(shí)現(xiàn)兩塊FPGA之間的通信總結(jié)

      2021-02-25 | rar | 0.64 MB | 次下載 | 免費(fèi)

      資料介紹

      1、兩塊fpga 之間采用12 根線連接，包括8 根數(shù)據(jù)線， 2 根同步時(shí)鐘線， 2 根使能信號(hào)線。

      2、每塊fpga 的引腳配置為[3:0]rxd （接受數(shù)據(jù)） ， rxc（接受時(shí)鐘） ， rxen（接受使能信號(hào)） ，[3:0]txd ， txc， txen。

      3、采用全雙工通信。

      4、同步時(shí)鐘均采用鎖相環(huán)產(chǎn)生時(shí)鐘，在末尾有產(chǎn)生過程。

      5、相互之間發(fā)送的數(shù)據(jù)為0~255，不過本程序沒加上使能信號(hào)。

      6、下面附上我的程序。

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