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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>高效的橢圓曲線密碼硬件設(shè)計(jì)方案

      高效的橢圓曲線密碼硬件設(shè)計(jì)方案

      2021-05-13 | rar | 2.25 MB | 次下載 | 免費(fèi)

      資料介紹

      　　近年來(lái)，通信領(lǐng)域得到了巨大的發(fā)展，網(wǎng)上銀行、移動(dòng)通信等應(yīng)用増加了資源受限環(huán)境下的安全需求。與傳統(tǒng)密碼算法相比，橢圓曲線密碼體制（ Elliptic curve cryptography，ECC）提供了更好的安全標(biāo)準(zhǔn)，為優(yōu)化性能參數(shù)提供了更大的空間。為此，文中提出了一種高效的橢圓曲線密碼硬件設(shè)計(jì)方案。該方案在已有研究的基礎(chǔ)上，利用投影坐標(biāo)系 LD Montgomery階梯算法對(duì)ECC中最核心的標(biāo)量乘運(yùn)算進(jìn)行了研究，并對(duì)群運(yùn)算層采用并行調(diào)度來(lái)縮短延遲;對(duì)于有限域運(yùn)算，采用位并行乘法算法和改進(jìn)的 Euclidean求逆算法來(lái)實(shí)現(xiàn);基于 Xilinx virtex5和 Virtex-7fpga器件，在二進(jìn)制域域長(zhǎng)分別為163，233和283時(shí)實(shí)現(xiàn)了該休系結(jié)構(gòu)。實(shí)驗(yàn)結(jié)果表明，該方案所需現(xiàn)場(chǎng)可編程門(mén)陣列（ Field-programmable Gate Array，F(xiàn)PGA）資源消耗更少，運(yùn)算速度更快，與其他方法相比，硬件資源消耗減少了52.9%，標(biāo)量乘法運(yùn)算速度提高了5倍，能更好地適用于資源受限設(shè)備的應(yīng)用。

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