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      電子發(fā)燒友網(wǎng)>電子資料下載>模擬數(shù)字>有關(guān)Verilog中的一些語法詳細資料說明

      有關(guān)Verilog中的一些語法詳細資料說明

      2019-07-25 | rar | 0.01 MB | 次下載 | 免費

      資料介紹

      本文檔的主要內(nèi)容詳細介紹的是有關(guān)Verilog中的一些語法詳細資料說明。

      　　位運算符

      　　1） ~ // 取反

      　　2） & // 按位與

      　　3） | // 按位或

      　　4） ^ // 按位異或

      　　5） ^~ // 按位同或（ 異或非）

      　　邏輯運算符

      　　在Verilog HDL 語言中存在三種邏輯運算符：

      　　1） && 邏輯與

      　　2） || 邏輯或

      　　3） ！ 邏輯非

      　　等式運算符

      　　在Verilog HDL 語言中存在四種等式運算符：

      　　1） == （ 等于）

      　　2） ！= （ 不等于）

      　　3） === （ 等于）

      　　4） ！== （ 不等于）

      　　“==” 和“！=” 又稱為邏輯等式運算符。其結(jié)果由兩個操作數(shù)的值決定。由于操作數(shù)中某些位可能是不定值x和高阻值z， 結(jié)果可能為不定值x。

      　　而“===” 和“！==” 運算符則不同， 它在對操作數(shù)進行比較時對某些位的不定值x和高阻值z也進行比較， 兩個操作數(shù)必需完全一致，其結(jié)果才是1，否則為0?！?==” 和“！==” 運算符常用于case表達式的判別， 所以又稱為“case 等式運算符” 。

      　　位移運算符

      　　左移：右邊的添0

      　　右移：左邊的添0，移除的位舍去

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