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AXI DMA測(cè)試
增加一個(gè)AXIDMA章節(jié),這部分內(nèi)容是很多例程的基礎(chǔ),難度不大但是也不小,需要徹底理解整個(gè)運(yùn)行機(jī)制。

圖4?61 測(cè)試框圖
處理器通過(guò)M_AXI_GP0接口和AXI_DMA通信,以設(shè)置、啟動(dòng)和監(jiān)控?cái)?shù)據(jù)傳輸。數(shù)據(jù)傳輸通過(guò)S_AXI_HP0接口。整個(gè)過(guò)程如下:
lPS 端 ARM 將數(shù)據(jù)發(fā)送給 DDR。
lPS 控制 DMA,使 DMA 通過(guò)數(shù)據(jù)通道讀取 DDR 中的數(shù)據(jù); DMA 將讀取到的數(shù)據(jù)傳給 FIFO。
lFIFO 將數(shù)據(jù)傳輸給 DMA; PS 控制 DMA,使 DMA 通過(guò)數(shù)據(jù)通道將數(shù)據(jù)寫入 DDR 中。
l傳輸校驗(yàn),對(duì)比接收數(shù)據(jù)與發(fā)送數(shù)據(jù)是否一致。
詳細(xì)的建立工程細(xì)節(jié)請(qǐng)參考例程下的《DOC》文件夾。
BD框圖:

圖4?62 BD框圖
SDK部分詳見(jiàn)《DOC》文件夾下的《AXI DMA LOOP SDK代碼說(shuō)明.docx》。
詳細(xì)代碼見(jiàn)百度云鏈接:
鏈接:https://pan.baidu.com/s/18hj_MzNwCo1QB6u9CA47ww
提取碼:open
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