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      電子發(fā)燒友網(wǎng)>電子資料下載>電子元器件應(yīng)用>跨導(dǎo)運(yùn)算放大器應(yīng)該如何設(shè)計(jì)實(shí)例詳細(xì)說明

      跨導(dǎo)運(yùn)算放大器應(yīng)該如何設(shè)計(jì)實(shí)例詳細(xì)說明

      2020-01-02 | pdf | 0.32 MB | 次下載 | 3積分

      資料介紹

      　　所設(shè)計(jì)的OTA要應(yīng)用于課程設(shè)計(jì)10bit cyclic ADC中。在開關(guān)電容ADC中，ADC的速度取決于級(jí)電路的建立速度，而級(jí)電路的建立過程可視為由大信號(hào)壓擺區(qū)和小信號(hào)線性建立區(qū)構(gòu)成，其中，小信號(hào)建立區(qū)的時(shí)間通常要占到總建立時(shí)間的80%~90%，因此，OTA的大信號(hào)壓擺率對(duì)ADC的速度影響較小；

      　　從另一個(gè)方面來說，壓擺率只取決于偏置電流，當(dāng)偏置電流和電容確定后，無論輸入管的VGS-VT是大是小，壓擺率都不變。對(duì)于連續(xù)信號(hào)處理電路，我們希望 OTA在整個(gè)設(shè)計(jì)帶寬內(nèi)工作時(shí)，輸出信號(hào)不會(huì)因?yàn)閿[率跟不上而幅度受限，這個(gè)時(shí)候需要SR/GBW大一些，即輸入管的VGS-VT大一些；但是，對(duì)于采樣信號(hào)處理電路，比如我們所要設(shè)計(jì)的ADC，當(dāng)我們確定好偏置電流，然后降低輸入管的 VGS-VT，這個(gè)時(shí)候，SR不變，GBW變大，即SR/GBW變小了，而最終的建立時(shí)間反而縮小了，ADC的速度加快了。因此，SPEC中沒有提出對(duì)SR的具體要求。

      　　注意：不同應(yīng)用對(duì)SR/GBW的不同要求！

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