使用Model Composer設(shè)計(jì)PID控制器的Versal ACAP應(yīng)用說明
2023-09-14 |
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資料介紹
本應(yīng)用筆記是對帶模型編輯器的PID控制器設(shè)計(jì)的擴(kuò)展(XAPP1341),面向 Versal? 自適應(yīng)計(jì)算和加速平臺 (ACAP)。隨著 Versal AI Core 系列的推出,Xilinx? 客戶可以選擇執(zhí)行可編程邏輯 (PL) 或人工智能引擎。此更新展示了 Vitis? 模型編輯器 (VMC) 的靈活性實(shí)現(xiàn)針對PL或AI的浮點(diǎn)數(shù)字信號處理(DSP)算法引擎實(shí)現(xiàn)。已知的黃金參考 Simulink? PID 模型演示了驗(yàn)證和調(diào)試兩種不同PL實(shí)現(xiàn)結(jié)果的獨(dú)立方法:VMC HLS 塊集或基于C++的數(shù)學(xué)序列器和單通道 AI 引擎實(shí)現(xiàn)如下圖所示。
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