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      電子發(fā)燒友網(wǎng)>電子資料下載>電子資料>使用千兆位收發(fā)器分?jǐn)?shù)PLL的全數(shù)字VCXO替代方案

      使用千兆位收發(fā)器分?jǐn)?shù)PLL的全數(shù)字VCXO替代方案

      2023-09-14 | pdf | 1.14 MB | 次下載 | 免費(fèi)

      資料介紹

      本應(yīng)用筆記提供了一個(gè)設(shè)計(jì)用于替代外部電壓控制的系統(tǒng)晶體振蕩器 （VCXO） 電路，利用千兆位收發(fā)器中的功能和關(guān)聯(lián)的 PLL。常見(jiàn)的設(shè)計(jì)要求是將收發(fā)器輸出的頻率或相位鎖定到輸入源（稱(chēng)為環(huán)路、恢復(fù)或從時(shí)序）。傳統(tǒng)上，外部時(shí)鐘清理器件或VCXO和PLL組件用于為以下收發(fā)器，因?yàn)榛?a href='http://www.brongaenegriffin.com/soft/data/30-91/' target='_blank' class='arckwlink_none'>FPGA邏輯的時(shí)鐘通常噪聲太大。雖然有效，但外部時(shí)鐘組件的功耗和成本損失是累加的，因?yàn)槊總€(gè)單獨(dú)的時(shí)鐘通道已生成。當(dāng)使用多個(gè)通道或在低成本系統(tǒng)中時(shí)，成本可能是重要。此外，添加許多外部時(shí)鐘源提供了更多機(jī)會(huì)板級(jí)串?dāng)_和干擾。
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