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簡(jiǎn)介：隨著雷達(dá)發(fā)射機(jī)技術(shù)的不斷發(fā)展，越來(lái)越多的新技術(shù)應(yīng)用于發(fā)射機(jī)設(shè)計(jì)中。復(fù)雜可編程邏輯器件CPLD和現(xiàn)場(chǎng)可編程門陣列FPGA，同以往的PAL和GAL器件相比，這些器件含有數(shù)量眾多的可編程邏輯宏單元或邏輯塊，規(guī)模大，組合能力強(qiáng)，設(shè)計(jì)成功能各異的邏輯電路，適合于時(shí)序、組合等邏輯電路。本文用CPLD對(duì)發(fā)射機(jī)控制功能進(jìn)行綜合處理，控制命令產(chǎn)生部分根據(jù)信號(hào)處理機(jī)通過(guò)串行鏈發(fā)來(lái)的控制命令產(chǎn)生控制命令，然后對(duì)發(fā)射機(jī)進(jìn)行相應(yīng)的控制，并對(duì)相關(guān)命令根據(jù)時(shí)序和故障情況進(jìn)行邏輯鏈鎖，達(dá)到最終控制發(fā)射機(jī)的目的。
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