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模擬/混合信號(hào)Ic設(shè)計(jì)一直是困擾很多中國(guó)Ic設(shè)計(jì)工程師的難題。與數(shù)字電路設(shè)計(jì)相比，模擬/混合電路設(shè)計(jì)要求更為嚴(yán)苛，而且需要嚴(yán)格的環(huán)境控制工藝。而對(duì)于深亞微米級(jí)的SOC設(shè)計(jì)還必須面對(duì)電源噪聲和數(shù)字電路的襯底耦合噪聲等問(wèn)題。在模擬/混合信號(hào)電路設(shè)計(jì)中，成功的設(shè)計(jì)可以說(shuō)一半以上要?dú)w功于Ic版圖設(shè)計(jì)，因?yàn)槟M/混合信號(hào)Ic設(shè)計(jì)的特殊性，信號(hào)之間的干擾大，再好的電路設(shè)計(jì)，如果不講究版圖設(shè)計(jì)，最終還是無(wú)法實(shí)現(xiàn)?？梢哉f(shuō)好的版圖意味著成功的電路。由于數(shù)字和模擬版圖設(shè)計(jì)之間存在著一些比較明顯的差別，例如，設(shè)計(jì)CMOS數(shù)字芯片時(shí)，主要目標(biāo)是優(yōu)化芯片的尺寸和提高密集度，而在模擬設(shè)計(jì)中，無(wú)論是CMOS還是雙極型電路，主要目標(biāo)并不是芯片的尺寸，而是優(yōu)化電路的性能、匹配程度、速度和各種功能方面的問(wèn)題，因此，在模擬/混合信號(hào)Ic版圖的設(shè)計(jì)中，應(yīng)注意版圖設(shè)計(jì)技巧的使用。
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