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國內(nèi)GPS衛(wèi)星信號模擬源大多基于“DSP+FPGA”架構(gòu)進行開發(fā)研制，DSP與FPGA是兩個獨立的時鐘域系統(tǒng)，存在異步數(shù)據(jù)交互的問題?；诮鉀QDSP計算所得導(dǎo)航電文以及載波控制字、偽碼控制字向FPCJA傳輸時發(fā)生數(shù)據(jù)丟失問題得目的，提出采用異步FIFO來緩存大量導(dǎo)航電文數(shù)據(jù)還有同步器來同步所傳輸?shù)妮d波控制字和偽碼控制字的方法。通過采用Altera公司的FIFO內(nèi)核來進行外圍接口信號和控制邏輯設(shè)計以及兩級觸發(fā)器級聯(lián)來實現(xiàn)同步器的試驗設(shè)計方法，得到所設(shè)計的緩存導(dǎo)航電文的異步FIFO輸出的數(shù)據(jù)結(jié)果正確以及系統(tǒng)穩(wěn)定的結(jié)論。
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