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DFT 偽碼捕獲算法在進(jìn)行偽碼搜索的同時(shí)估計(jì)多普勒頻偏，為了滿足捕獲精度要求，需
要增加DFT 點(diǎn)數(shù)，但隨著運(yùn)算點(diǎn)數(shù)的增加硬件實(shí)現(xiàn)難度成倍增長(zhǎng)。本文提出一種基于FPGA 的在不增加DFT 點(diǎn)數(shù)的前提下實(shí)現(xiàn)高精度偽碼捕獲的方法，詳細(xì)介紹了如何通過(guò)采用查找表和浮動(dòng)窗等方法在保證系統(tǒng)性能的同時(shí)節(jié)省資源，通過(guò)在FPGA 器件中驗(yàn)證表明該方法捕獲速度快，精度高，硬件實(shí)現(xiàn)簡(jiǎn)單，占用資源少，有很強(qiáng)的實(shí)用價(jià)值。
要增加DFT 點(diǎn)數(shù)，但隨著運(yùn)算點(diǎn)數(shù)的增加硬件實(shí)現(xiàn)難度成倍增長(zhǎng)。本文提出一種基于FPGA 的在不增加DFT 點(diǎn)數(shù)的前提下實(shí)現(xiàn)高精度偽碼捕獲的方法，詳細(xì)介紹了如何通過(guò)采用查找表和浮動(dòng)窗等方法在保證系統(tǒng)性能的同時(shí)節(jié)省資源，通過(guò)在FPGA 器件中驗(yàn)證表明該方法捕獲速度快，精度高，硬件實(shí)現(xiàn)簡(jiǎn)單，占用資源少，有很強(qiáng)的實(shí)用價(jià)值。
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