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本文對(duì)超聲相控陣檢測(cè)系統(tǒng)接收裝置進(jìn)行了以下研究：第一，介紹了超聲相控陣檢測(cè)原理及其關(guān)鍵技術(shù)，以及超聲波傳播過程中的衰減規(guī)律；第二，重點(diǎn)對(duì)超聲相控陣延時(shí)接收算法與等強(qiáng)度接收算法進(jìn)行了詳細(xì)分析，建立相應(yīng)的數(shù)學(xué)模型，將DSP Builder軟件應(yīng)用到算法的實(shí)現(xiàn)當(dāng)中，編寫了延時(shí)接收算法和等強(qiáng)度接收算法的VHDL語言程序，并通過實(shí)驗(yàn)數(shù)據(jù)驗(yàn)證了程序的正確性；第三，設(shè)計(jì)了8通道超聲相控陣檢測(cè)系統(tǒng)接收裝置的各部分硬件電路，制作了接收裝置數(shù)據(jù)采集卡；第四，以Quartus II軟件為開發(fā)平臺(tái)，選擇Altera公司Cyclone II系列FPGA芯片作為裝置的主控芯片，采用模塊化設(shè)計(jì)方式運(yùn)用VHDL語言設(shè)計(jì)和編寫了接收裝置各部分控制程序，并進(jìn)行了時(shí)序與功能仿真，將延時(shí)接收算法程序和等強(qiáng)度接收算法程序與系統(tǒng)各部分控制程序下載至一塊FPGA芯片中，實(shí)現(xiàn)算法與控制的單片集成，脫離了上位機(jī)，大大地縮小裝置總體積，提高便攜性和運(yùn)算速率。
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