代碼

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代碼就是程序員用開(kāi)發(fā)工具所支持的語(yǔ)言寫出來(lái)的源文件，是一組由字符、符號(hào)或信號(hào)碼元以離散形式表示信息的明確的規(guī)則體系。

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代碼技術(shù)

對(duì)于代碼的規(guī)范性不管是做純軟件開(kāi)發(fā)的還是做嵌入式開(kāi)發(fā)的或者使用各種語(yǔ)言的，都是非常重要的。代碼的規(guī)范性對(duì)編寫人員對(duì)代碼后期的維護(hù)以及其他開(kāi)發(fā)人員閱讀等都...

2023-04-15 標(biāo)簽：嵌入式 Switch 函數(shù) 1.4k 0

嵌入式代碼的注釋問(wèn)題

2023-04-15 標(biāo)簽：嵌入式接口函數(shù) 1.5k 0

解析PCIe第50萬(wàn)行代碼的風(fēng)格

來(lái)，看看S家的第509525行PCIe代碼，一個(gè)寄存器在一個(gè)觸發(fā)信號(hào)里面賦值兩次，第一句所有bit直接全部賦值0，第二句部分低bit賦值，信號(hào)本身是9:...

2023-04-15 標(biāo)簽：寄存器 PCIe 代碼 1.4k 0

Verilog中循環(huán)語(yǔ)句簡(jiǎn)介

在這篇文章中，我們討論了可以在verilog中使用的不同類型的循環(huán) - for循環(huán)，while循環(huán)，forever循環(huán)和repeat循環(huán)。

2023-04-15 標(biāo)簽：Verilog 時(shí)鐘代碼 4.1k 0

如何安裝Python解釋器

安裝Python解釋器是搭建Python編程環(huán)境的第一步。Python解釋器是Python編程語(yǔ)言的核心組件，負(fù)責(zé)解析和執(zhí)行Python代碼。在本文中，...

2023-04-14 標(biāo)簽：WINDOWS 編程語(yǔ)言代碼 5.9k 0

深入淺出編譯優(yōu)化選項(xiàng)（上）

在前文《如何為嵌入式軟件開(kāi)發(fā)選擇編譯器》中講到編譯器對(duì)于嵌入式軟件開(kāi)發(fā)的重要性，以及如何選擇一款優(yōu)秀的編譯器。文中也比較了現(xiàn)有主流編譯器的編譯優(yōu)...

2023-04-14 標(biāo)簽：嵌入式 IAR 優(yōu)化 2.9k 0

一文詳解嵌入式位運(yùn)算

嵌入式位運(yùn)算是嵌入式系統(tǒng)中常用的優(yōu)化技巧之一，它可以通過(guò)位運(yùn)算操作來(lái)實(shí)現(xiàn)一些常見(jiàn)的數(shù)學(xué)運(yùn)算、邏輯運(yùn)算等，從而提高程序的執(zhí)行效率。

2023-04-13 標(biāo)簽：嵌入式寄存器二進(jìn)制 2.6k 0

如何選擇正確的嵌入式操作系統(tǒng)類型

都是非標(biāo)準(zhǔn)的操作系統(tǒng)。對(duì)于針對(duì)比較狹窄領(lǐng)域，尤其是使用帶有非常有限資源的微控制器來(lái)說(shuō)，這是一個(gè)很正常的現(xiàn)象。操作系統(tǒng)中最基本的操作是建立一個(gè)帶有能夠處理...

2023-04-13 標(biāo)簽：微控制器操作系統(tǒng)代碼 1.1k 0

如何動(dòng)態(tài)添加修改刪除定時(shí)任務(wù)？

如何動(dòng)態(tài)添加修改刪除定時(shí)任務(wù)？那么我們一起看看具體怎么實(shí)現(xiàn)，先看下本節(jié)大綱：（1）思路說(shuō)明；（2）代碼解析；（3）修改定時(shí)任務(wù)執(zhí)...

2023-04-12 標(biāo)簽：JAVA 代碼 1.6k 0

履約核心引擎低代碼化原理與實(shí)踐

基于此，京東供應(yīng)鏈研發(fā)部自研了一套，面向業(yè)務(wù)角色的海納低代碼規(guī)則引擎平臺(tái)，產(chǎn)品定位是面向業(yè)務(wù)、研發(fā)多角色一體化的零低代碼開(kāi)發(fā)平臺(tái)，這其中規(guī)則引擎是其最核...

2023-04-11 標(biāo)簽：引擎代碼應(yīng)用程序 932 0

函數(shù)指針和回調(diào)函數(shù)的使用方法

了解開(kāi)發(fā)語(yǔ)言的朋友應(yīng)該都會(huì)對(duì)回調(diào)函數(shù)有所了解，在很多的程序開(kāi)發(fā)語(yǔ)言中都能看到回調(diào)的身影。很多場(chǎng)景下，當(dāng)某個(gè)條件成立以后我們希望代碼執(zhí)行某些指定的部分，這...

2023-04-10 標(biāo)簽：C語(yǔ)言指針代碼 1.6k 0

17個(gè)非常有用的Python技巧

Python 是一門非常優(yōu)美的語(yǔ)言，其簡(jiǎn)潔易用令人不得不感概人生苦短。在本文中，作者 Gautham Santhosh 帶我們回顧了 17 個(gè)非常有用的...

2023-04-10 標(biāo)簽：編程語(yǔ)言字符串代碼 967 0

一個(gè)簡(jiǎn)單的8位處理器完整設(shè)計(jì)過(guò)程及verilog代碼

一個(gè)簡(jiǎn)單的8位處理器完整設(shè)計(jì)過(guò)程及verilog代碼,適合入門學(xué)習(xí)參考，并含有作者個(gè)人寫的指令執(zhí)行過(guò)程。

2023-04-10 標(biāo)簽：處理器寄存器 Verilog 5.2k 0

速度面積互換設(shè)計(jì)原則簡(jiǎn)析

速度和面積一直都是FPGA設(shè)計(jì)中非常重要的兩個(gè)指標(biāo)。所謂速度，是指整個(gè)工程穩(wěn)定運(yùn)行所能夠達(dá)到的最高時(shí)鐘頻率，它不僅和FPGA內(nèi)部各個(gè)寄存器的建立時(shí)間余量

2023-04-10 標(biāo)簽：FPGA設(shè)計(jì)存儲(chǔ)器時(shí)鐘 1.9k 0

如何在Ubuntu中安裝IDLE Python IDE

當(dāng)初學(xué)Python時(shí)，設(shè)置編碼環(huán)境可能會(huì)很具有挑戰(zhàn)性。IDLE（集成開(kāi)發(fā)和學(xué)習(xí)環(huán)境）是一個(gè)Python IDE，可簡(jiǎn)化相同的過(guò)程。安裝后，您可以立即開(kāi)始編碼。

2023-04-10 標(biāo)簽：IDE 瀏覽器 Ubuntu 1.2k 0

Windows下搭建ARM11裸機(jī)開(kāi)發(fā)環(huán)境：Eclipse+JLink調(diào)試代碼

之前，寫過(guò)兩篇文章，介紹了在Windows下搭建ARM11的裸機(jī)開(kāi)發(fā)環(huán)境，以及使用Eclipse創(chuàng)建ARM11的裸機(jī)程序管理工程，需要的朋友可以過(guò)去看看。

2023-04-08 標(biāo)簽：arm WINDOWS 調(diào)試 3.1k 0

SpringBoot-動(dòng)態(tài)定時(shí)任務(wù)調(diào)度

先說(shuō)業(yè)務(wù)場(chǎng)景，根據(jù)用戶輸入的cron表達(dá)式進(jìn)行定時(shí)調(diào)度，舉個(gè)例子：如圖

2023-04-07 標(biāo)簽：代碼 spring SpringBoot 1.3k 0

SpringBoot如何實(shí)現(xiàn)定時(shí)任務(wù)（上）

SpringBoot創(chuàng)建定時(shí)任務(wù)的方式很簡(jiǎn)單，主要有兩種方式：一、基于注解的方式（@Scheduled）二、數(shù)據(jù)庫(kù)動(dòng)態(tài)配置。實(shí)際開(kāi)發(fā)中，第一種需要在代碼...

2023-04-07 標(biāo)簽：代碼 spring Boot 1.7k 0

SpringBoot如何實(shí)現(xiàn)定時(shí)任務(wù)（下）

2023-04-07 標(biāo)簽：代碼 spring Boot 1.5k 0

基于符號(hào)執(zhí)行的測(cè)試生成

符號(hào)執(zhí)行作為一個(gè)經(jīng)典的程序分析技術(shù)，在 21 世紀(jì)受到了研究者的廣泛重視，并為軟件測(cè)試提供了一個(gè)在白盒情況下精準(zhǔn)和詳盡地測(cè)試程序的全新思路，近年來(lái)不斷出...

2023-04-07 標(biāo)簽：接口代碼軟件測(cè)試 1.3k 0

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Protues

Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

Altium Designer

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FPGA芯片

FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

+關(guān)注

ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
AD10

AD10

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識(shí)別

識(shí)別

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FPGA開(kāi)發(fā)板

FPGA開(kāi)發(fā)板

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FPGA開(kāi)發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車電子產(chǎn)品的開(kāi)發(fā)周期是漫長(zhǎng)的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
PCB封裝

PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開(kāi)發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
語(yǔ)音交互

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PCB封裝庫(kù)

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AD09

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PDN

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QuickPcb

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Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

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powerlink

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Protel 99 se

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面包板

面包板

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面包板是由于板子上有很多小插孔，專為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
candence

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AXI

AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問(wèn)和亂序訪問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
特性阻抗

特性阻抗

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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
時(shí)鐘源

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時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
AD采樣

AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
驅(qū)動(dòng)電流

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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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FPGA教程

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紅外觸摸屏

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