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fifo

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First Input First Output的縮寫，先入先出隊(duì)列，這是一種傳統(tǒng)的按序執(zhí)行方法，先進(jìn)入的指令先完成并引退，跟著才執(zhí)行第二條指令。

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fifo技術(shù)

時(shí)序約束出現(xiàn)時(shí)序違例(Slack為負(fù)數(shù))，如何處理？

2023-07-10 標(biāo)簽：fifo 加法器時(shí)序約束 7k 0

采用單芯片F(xiàn)IFO設(shè)計(jì)的GPIB接口專用芯片TNT4882的特性及應(yīng)用研究

TNT4882是美國(guó)NI公司的一款單芯片、高速、聽(tīng)/講功能的兼?zhèn)涞腉PIB（General purpose interface bus）接口專用芯片。它...

2020-05-18 標(biāo)簽：芯片寄存器 fifo 6.7k 0

如何在Vivado中配置FIFO IP核

Vivado IP核提供了強(qiáng)大的FIFO生成器，可以通過(guò)圖形化配置快速生成FIFO IP核。

2023-08-07 標(biāo)簽：接口 fifo IP核 6.7k 0

抓取SEM IP的串口log的詳細(xì)步驟

SEM IP在上板調(diào)試過(guò)程中有時(shí)會(huì)出現(xiàn)一些錯(cuò)誤，比如無(wú)法執(zhí)行IP的插錯(cuò)糾錯(cuò)功能，或者自身的初始化無(wú)法完成等等，需要對(duì)SEM IP本身進(jìn)行調(diào)試定位。我們最...

2022-05-12 標(biāo)簽：賽靈思 fifo 串口 6.7k 0

如何解決異步FIFO跨時(shí)鐘域亞穩(wěn)態(tài)問(wèn)題？

跨時(shí)鐘域的問(wèn)題：前一篇已經(jīng)提到要通過(guò)比較讀寫指針來(lái)判斷產(chǎn)生讀空和寫滿信號(hào)，但是讀指針是屬于讀時(shí)鐘域的，寫指針是屬于寫時(shí)鐘域的，而異步FIFO的讀寫時(shí)鐘域...

2018-09-05 標(biāo)簽：寄存器 FIFO 6.5k 0

隊(duì)列Queue的常用方法有哪些

FIFO（先入先出)隊(duì)列Queue，LIFO（后入先出）隊(duì)列LifoQueue，和優(yōu)先級(jí)隊(duì)列PriorityQueue。

2022-08-19 標(biāo)簽：cpu fifo URL 6.5k 0

FIFO的使用介紹

FIFO的使用非常廣泛，一般用于不同時(shí)鐘域之間的數(shù)據(jù)傳輸，或者用于不同數(shù)據(jù)寬度之間的數(shù)據(jù)匹配。在實(shí)際的工程應(yīng)用，可以根據(jù)需要自己寫FIFO。不考慮資源的...

2022-08-14 標(biāo)簽：數(shù)據(jù)傳輸 fifo SoC芯片 6.3k 0

12位并行高速A/D轉(zhuǎn)換芯片THS1206的功能構(gòu)造和工作原理分析

ＴＨＳ１２０６有４個(gè)模擬信號(hào)輸入端，每個(gè)輸入端既可作為４個(gè)單獨(dú)的非極性信號(hào)的輸入通道，也可作為２個(gè)差分信號(hào)輸入通道，而且兩種方式可同時(shí)混合使用，具體的輸...

2020-07-21 標(biāo)簽：芯片寄存器 fifo 6.2k 0

CRYP加密處理器簡(jiǎn)介、主要特性及功能說(shuō)明

MCU加/解密可分為對(duì)稱加/解密、非對(duì)稱加/解密、以及HASH算法，以上加/解密算法均可通過(guò)CAVP FIPS認(rèn)證，用于各類安全相關(guān)應(yīng)用。其中，包含DE...

2023-09-22 標(biāo)簽：處理器 mcu fifo 6.2k 0

AXI FIFO和AXI virtual FIFO兩個(gè)IP的使用方法

FIFO 是我們?cè)O(shè)計(jì)中常用的工具，因?yàn)樗鼈兪刮覀兡軌蛟谶M(jìn)行信號(hào)和圖像處理時(shí)緩沖數(shù)據(jù)。我們還使用異步FIFO來(lái)處理數(shù)據(jù)總線的時(shí)鐘域交叉問(wèn)題。

2022-11-04 標(biāo)簽：fpga fifo AXI 6.2k 0

FPGA學(xué)習(xí)筆記：FIFO IP核的使用方法

FIFO（First In First Out，先入先出），是一種數(shù)據(jù)緩沖器，用來(lái)實(shí)現(xiàn)數(shù)據(jù)先入先出的讀寫方式。數(shù)據(jù)按順序?qū)懭?FIFO，先被寫入的數(shù)...

2023-09-07 標(biāo)簽：fpga 存儲(chǔ)器緩沖器 6k 0

基于FPGA片上集成的高速FIFO實(shí)現(xiàn)緩存以及同步數(shù)據(jù)傳輸?shù)膽?yīng)用

隨著測(cè)試環(huán)境越來(lái)越復(fù)雜，需要采集的參數(shù)種類越來(lái)越多，要求采集系統(tǒng)連續(xù)采集各種傳感器輸出的模擬信號(hào)，而目前常用的固態(tài)存儲(chǔ)器件FLASH的寫入速率比較低。...

2018-07-12 標(biāo)簽：FPGA FIFO 6k 0

【ZYNQ Ultrascale+ MPSOC FPGA教程】第八章FPGA片內(nèi)FIFO讀寫測(cè)試實(shí)驗(yàn)

FIFO: First in, First out代表先進(jìn)的數(shù)據(jù)先出，后進(jìn)的數(shù)據(jù)后出。Xilinx在VIVADO里為我們已經(jīng)提供了FIFO的IP核, 我...

2021-01-22 標(biāo)簽：fpga Xilinx fifo 5.9k 0

MSPM0L1306開(kāi)發(fā)板教程之I2C

MSPM0L系列的I2C支持主從模式，有7位地址位可以設(shè)置，速率最大1Mbps，無(wú)論是主機(jī)或者從機(jī)，發(fā)送和接收都有獨(dú)立的8個(gè)字節(jié)FIFO。

2023-06-30 標(biāo)簽：fifo 時(shí)鐘 EEPROM 5.6k 0

FPGA零基礎(chǔ)學(xué)習(xí)之Vivado-FIFO使用教程

FIFO的英文全稱叫做First in First out，即先進(jìn)先出。這也就決定了這個(gè)IP核的特殊性，先寫進(jìn)去的數(shù)據(jù)優(yōu)先被讀出，所以，F(xiàn)IFO是不需要...

2023-06-09 標(biāo)簽：fpga fifo 時(shí)鐘 5.6k 0

FIFO 同步、異步以及Verilog代碼實(shí)現(xiàn)

FIFO 很重要，之前參加的各類電子公司的邏輯設(shè)計(jì)的筆試幾乎都會(huì)考到。

2017-02-11 標(biāo)簽：FIFO 同步異步 5.1k 0

基于LabVIEW FPGA模塊程序設(shè)計(jì)特點(diǎn)的FIFO深度設(shè)定詳解

為了解決基于LabVIEWFPGA模塊的DMAFIFO深度設(shè)定不當(dāng)帶來(lái)的數(shù)據(jù)不連續(xù)問(wèn)題，結(jié)合LabVIEWFPGA的編程特點(diǎn)和DMA FIFO的工作原理...

2019-01-04 標(biāo)簽：FPGA LabVIEW FIFO 5.1k 0

Studio 5000高級(jí)指令FIFO的應(yīng)用案例

前言：工業(yè)自動(dòng)化項(xiàng)目的控制邏輯雖然可以層層分解，這樣就可以使用大量相對(duì)比較簡(jiǎn)單的編程指令去實(shí)現(xiàn)，但是，某些復(fù)雜工序很難使用簡(jiǎn)單指令堆砌而成，這時(shí)，如果你...

2022-11-29 標(biāo)簽：控制器 WINDOWS fifo 5.1k 0

FPGA之FIFO的原理概述

FIFO隊(duì)列不對(duì)報(bào)文進(jìn)行分類，當(dāng)報(bào)文進(jìn)入接口的速度大于接口能發(fā)送的速度時(shí)，F(xiàn)IFO按報(bào)文到達(dá)接口的先后順序讓報(bào)文進(jìn)入隊(duì)列，同時(shí)，F(xiàn)IFO在隊(duì)列的出口讓報(bào)...

2019-11-29 標(biāo)簽：fpga fifo 5k 0

FPGA設(shè)計(jì)與DSP設(shè)計(jì)相比到底有什么區(qū)別

Q：FPGA設(shè)計(jì)與DSP設(shè)計(jì)相比，最大的不同之處在哪里？A：這個(gè)問(wèn)題要從多個(gè)角度看。它們都用于某個(gè)功能的硬件

2019-05-03 標(biāo)簽：DSP FPGA FIFO 4.9k 0

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Protues

Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

Altium Designer

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FPGA芯片

FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

+關(guān)注

ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
AD10

AD10

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識(shí)別

識(shí)別

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FPGA開(kāi)發(fā)板

FPGA開(kāi)發(fā)板

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FPGA開(kāi)發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車電子產(chǎn)品的開(kāi)發(fā)周期是漫長(zhǎng)的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
PCB封裝

PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開(kāi)發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
語(yǔ)音交互

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PCB封裝庫(kù)

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PDN

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QuickPcb

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Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

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powerlink

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Protel 99 se

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面包板

面包板

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面包板是由于板子上有很多小插孔，專為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
candence

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AXI

AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問(wèn)和亂序訪問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
特性阻抗

特性阻抗

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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
時(shí)鐘源

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時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
AD采樣

AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
驅(qū)動(dòng)電流

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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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FPGA教程

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紅外觸摸屏

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