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FPGA(Field-Programmable Gate Array),即現(xiàn)場(chǎng)可編程門(mén)陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專(zhuān)用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門(mén)電路數(shù)有限的缺點(diǎn)。
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當(dāng)我們需要進(jìn)行計(jì)算時(shí),通常會(huì)選擇使用基于指令的架構(gòu),比如中央處理器(CPU)或圖形處理器(GPU),編寫(xiě)適用于這些架構(gòu)的軟件程序。這些架構(gòu)是通用的,可以...
FPGA設(shè)計(jì)的常用基本時(shí)序路徑分析
該條路徑包括了觸發(fā)器內(nèi)部clock-to-Q的延遲,觸發(fā)器之間的由組合邏輯造成的路徑延遲以及目標(biāo)觸發(fā)器的建立時(shí)間,其延時(shí)是數(shù)據(jù)從源觸發(fā)器開(kāi)始,在下一個(gè)時(shí)...
Inter-IC Sound Interface(簡(jiǎn)稱(chēng)I2S)是由飛利浦公司開(kāi)發(fā),用于通過(guò)不同IC之間的串行接口(例如從處理器到DAC)傳輸數(shù)字音頻數(shù)據(jù)...
USB 頻譜分析儀的性能差異很大。在低端,它們相對(duì)簡(jiǎn)單,提供非常低的成本和基本性能。在高端,許多測(cè)試儀器可以與更大、更昂貴的測(cè)試儀器競(jìng)爭(zhēng)。一些 USB ...
狀態(tài)機(jī)卡住的場(chǎng)景——通過(guò)狀態(tài)跳轉(zhuǎn)條件的DFX信號(hào)去判斷卡住的原因
2024-01-15 標(biāo)簽:fpga寄存器狀態(tài)機(jī) 631 0
基于Xilinx K7-410T的高速DAC之AD9129開(kāi)發(fā)筆記(二)
上一篇文章我們簡(jiǎn)單介紹了AD9129的基礎(chǔ)知識(shí),包括芯片的重要特性,外部接口相關(guān)的信號(hào)特性等。本篇我們重點(diǎn)介紹下項(xiàng)目中FPGA與AD9129互聯(lián)的原理圖...
什么是FPGA原型驗(yàn)證?FPGA原型設(shè)計(jì)的好處是什么?
FPGA原型設(shè)計(jì)是一種成熟的技術(shù),用于通過(guò)將RTL移植到現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)來(lái)驗(yàn)證專(zhuān)門(mén)應(yīng)用的集成電路(ASIC),專(zhuān)用標(biāo)準(zhǔn)產(chǎn)品(ASSP)和片上...
基于FPGA芯片的CAN控制器系統(tǒng)設(shè)計(jì)
CAN 是 Controller Area Network 的縮寫(xiě),是ISO國(guó)際標(biāo)準(zhǔn)化的串行通信協(xié)議。CAN總線協(xié)議已成為汽車(chē)計(jì)算機(jī)控制系統(tǒng)和嵌入式工業(yè)...
生成時(shí)鐘包括自動(dòng)生成時(shí)鐘(又稱(chēng)為自動(dòng)衍生時(shí)鐘)和用戶(hù)生成時(shí)鐘。自動(dòng)生成時(shí)鐘通常由PLL或MMCM生成,也可以由具有分頻功能的時(shí)鐘緩沖器生成如7系列FPG...
PWM產(chǎn)生的方法有很多種,小編將常用的幾種產(chǎn)生方法作了一個(gè)整理以及分類(lèi),下面我們來(lái)了解一下。
2024-01-11 標(biāo)簽:fpgaPWMLED驅(qū)動(dòng) 4178 0
PCB設(shè)計(jì)(二):漢化及設(shè)計(jì)
器件庫(kù)的制作,也分為兩個(gè)部分,原理圖庫(kù)和封裝庫(kù)。原理圖庫(kù)是我們?cè)谠韴D中看到的圖示。封裝庫(kù)是我們器件真實(shí)尺寸的反饋。我們將二者合二為一,就生成了我們的器...
2024-01-10 標(biāo)簽:fpga軟件PCB設(shè)計(jì) 883 0
關(guān)于FPGA的開(kāi)源項(xiàng)目介紹
Hello,大家好,之前給大家分享了大約一百多個(gè)關(guān)于FPGA的開(kāi)源項(xiàng)目,涉及PCIe、網(wǎng)絡(luò)、RISC-V、視頻編碼等等,這次給大家?guī)?lái)的是不枯燥的娛樂(lè)項(xiàng)...
隨著片上系統(tǒng)(SoC)的出現(xiàn),例如集CPU的靈活性與FPGA的處理能力于一體的Xilinx Zynq All Programmable SoC,設(shè)計(jì)人員...
2024-01-09 標(biāo)簽:fpga電機(jī)控制運(yùn)算放大器 630 0
基于ZYNQ FPGA構(gòu)建嵌入式的模擬計(jì)算板卡
板卡基于高速400M 采樣AD 和ZYNQ FPGA構(gòu)建嵌入式的模擬計(jì)算板卡, 可用于工業(yè)雷達(dá),行業(yè)雷達(dá)的場(chǎng)合。板卡使用工業(yè)級(jí)芯片。
可編程AES加解密IP內(nèi)建密鑰擴(kuò)展功能,使用初始密鑰產(chǎn)生擴(kuò)展密鑰,用于加解密過(guò)程??删幊藺ES加解密IP處理128-bit分組數(shù)據(jù),并且支持可編程的密鑰...
2024-01-09 標(biāo)簽:fpga數(shù)據(jù)通路數(shù)據(jù)總線 825 0
在原理圖中直接執(zhí)行更新命令至PCB,如圖12-12所示,在導(dǎo)入的界面中有9張?jiān)韴D(相同模塊數(shù)分割的原理圖張數(shù))。原理圖生成Room Page10-NE...
對(duì)于數(shù)字設(shè)計(jì)人員來(lái)講,只要信號(hào)從一個(gè)時(shí)鐘域跨越到另一個(gè)時(shí)鐘域,那么就可能發(fā)生亞穩(wěn)態(tài)。我們稱(chēng)為“跨時(shí)鐘域”即“Clock Domain Crossing”...
FPGA、ASIC、GPU誰(shuí)是最合適的AI芯片?
CPU、GPU遵循的是馮·諾依曼體系結(jié)構(gòu),指令要經(jīng)過(guò)存儲(chǔ)、譯碼、執(zhí)行等步驟,共享內(nèi)存在使用時(shí),要經(jīng)歷仲裁和緩存。 而FPGA和ASIC并不是馮·諾依...
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