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標(biāo)簽 > fpga
FPGA(Field-Programmable Gate Array),即現(xiàn)場可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
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良好的掌握PCB設(shè)計(jì)才能更好的學(xué)習(xí)FPGA
今天的電子技術(shù)幾乎是數(shù)字邏輯的天下,雖然傳感器、模擬電路等也非常重要,但從比重上來講,無疑越來越多的處理、算法都將在數(shù)字領(lǐng)域?qū)崿F(xiàn)。 因此PLD/FPGA...
使用FPGA的系統(tǒng)供電為處理多個(gè)電源系統(tǒng)的主題提供了很好的對象課程。正確控制FPGA電源可以決定可靠、可重復(fù)的設(shè)計(jì)與實(shí)驗(yàn)室中或更糟糕的現(xiàn)場可能出現(xiàn)的災(zāi)難...
“把算法用RTL實(shí)現(xiàn),怎么做?” 這個(gè)問題,對于芯片設(shè)計(jì)工程師、芯片算法工程師、FPGA工程師來講,是非常重要的問題。 算法時(shí)代來臨, 學(xué)習(xí) 將算法轉(zhuǎn)化...
深入開源處理器內(nèi)部,RISC-V技術(shù)分析
FPGA技術(shù)與(V)HDL的結(jié)合在電子專家中很受歡迎,RISC-V為專業(yè)應(yīng)用增加了開源途徑。在本文中,我們測試了一些在Elektor的“Alchitry...
FPGA領(lǐng)域NoC硬件架構(gòu)下的應(yīng)用
交換機(jī)根據(jù)所選拓?fù)洳捎迷诰W(wǎng)絡(luò)節(jié)點(diǎn)之間路由信號的任務(wù)。請注意,NoC 的架構(gòu)假設(shè)使用了一個(gè)相當(dāng)強(qiáng)大的開關(guān),這將提供最低水平的延遲(最多納秒)。
基于Cyclone系列FPGA器件和UART功能實(shí)現(xiàn)誤碼率測試儀器的設(shè)計(jì)
在通信系統(tǒng)的設(shè)計(jì)實(shí)現(xiàn)過程中,都需要測試系統(tǒng)的誤碼性能。而常見的誤碼率測試儀多數(shù)專用于測試各種標(biāo)準(zhǔn)高速信道,不便于測試實(shí)際應(yīng)用中大量的專用信道,并且價(jià)格昂...
2020-07-24 標(biāo)簽:fpga測試系統(tǒng)uart 1194 0
基于FPGA EPlS30芯片和AD變換器實(shí)現(xiàn)導(dǎo)航系統(tǒng)的設(shè)計(jì)
INS/GPS組合導(dǎo)航系統(tǒng)在軍事領(lǐng)域和民用方面的運(yùn)動(dòng)載體中得到了廣泛應(yīng)用。INS是組合導(dǎo)航系統(tǒng)中的核心部分,涉及多個(gè)陀螺儀、多個(gè)加速度計(jì)和溫度傳感器等眾...
本模塊實(shí)現(xiàn)輸入與輸出位寬相同數(shù)據(jù)加法,并對結(jié)果進(jìn)行四舍五入截位,對標(biāo)matlab round函數(shù)。
spi master接口的fpga實(shí)現(xiàn)
前言 當(dāng)你器件的引腳賊少的時(shí)候,需要主機(jī)和從機(jī)通信,spi就派上了用場,它可以一對多,但只是片選到的從機(jī)能和主機(jī)通信,其他的掛機(jī)。 spi:serial...
FPGA 芯片在數(shù)據(jù)中心領(lǐng)域主要用于硬件加速,在云服務(wù)器廠商中已有廣泛部署。數(shù)據(jù)中心使用 FPGA 芯片代替?zhèn)鹘y(tǒng)的 CPU 方案后,處理其自定義算法時(shí)可...
淺談華為基站的PCB電路設(shè)計(jì)結(jié)構(gòu)
該基站的雙工器似乎是虹膜耦合腔濾波器,與一些腔間耦合。輸入和輸出的耦合是T,是諧振器上的一個(gè)連接部分,而不是耦合回路。頻率由電容帽調(diào)節(jié),濾波器是寬信號的...
靈活的視頻監(jiān)控/安全系統(tǒng)實(shí)現(xiàn)方案
視頻監(jiān)控和安全行業(yè)正在經(jīng)歷著一場巨大的變革,正在從傳統(tǒng)的模擬閉路電視攝像機(jī)向基于邏輯的數(shù)字?jǐn)z像機(jī)的方向發(fā)展。更高的視頻分辨率、圖像信號處理、先進(jìn)的視頻分...
2013-06-13 標(biāo)簽:FPGA視頻監(jiān)控安全系統(tǒng) 1190 0
對設(shè)計(jì)者很通常的情況是花費(fèi)幾天或幾周的時(shí)間圍繞一個(gè)設(shè)計(jì)來滿足時(shí)序,甚至多半利用上面描述的自動(dòng)種子變化,只面對可以起伏通過已有布局的小改變和時(shí)序特性完全改變。
安路科技EF3L70/EF3LA0器件Freeze IO功能介紹
在FPGA位流升級過程中,器件IO信號保持不變,在新版本位流加載完成后,重新接管上次位流IO保持的信號,此特性即為Freeze IO。
謹(jǐn)慎地選擇高端 FPGA (包括 Arria 10) 的電源管理解決方案應(yīng)謹(jǐn)慎地選擇。經(jīng)過審慎考慮的電源管理設(shè)計(jì)可縮減 PCB 尺寸、重量和復(fù)雜性,并可...
基于FPGA的視覺、聽覺誘發(fā)電位系統(tǒng)的設(shè)計(jì)
誘發(fā)電位是神經(jīng)系統(tǒng)接受各種外界刺激后所產(chǎn)生的特異性電反應(yīng)。它在中樞神經(jīng)系統(tǒng)及周圍神經(jīng)系統(tǒng)的相應(yīng)部位被檢出,與刺激有鎖時(shí)關(guān)系的電位變化,具有能定量及定位的...
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