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FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎上進一步發(fā)展的產(chǎn)物。它是作為專用集成電路（ASIC）領域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點。

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FPGA實戰(zhàn)開發(fā)技巧（12）

在大規(guī)模設計的調試應該按照和設計理念相反的順序，從底層測試，主要依靠ChipScope Pro 工具。下面主要介紹ChipScope Pro、FPGA ...

2017-02-11 標簽：FPGA Xilinx 761 0

FPGA實戰(zhàn)開發(fā)技巧（11）

在串行模式下，需要微處理器或微控制器等外部主機通過同步串行接口將配置數(shù)據(jù)串行寫入FPGA芯片，其模式選擇信號M[2:0]=3’b111

2017-02-11 標簽：FPGA 賽靈思 1087 0

FPGA中的多時鐘域設計

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2017-02-11 標簽：FPGA 多時鐘域 1382 0

論工業(yè)控制系統(tǒng)的FPGA設計方法（3）

上次博文簡要分析了人們研究使用FPGA來進行工業(yè)控制的驅動力，并介紹了FPGA器件與開發(fā)工具。隨著器件成本的降低和器件性能的上升，F(xiàn)PGA必將在工業(yè)控制...

2017-02-11 標簽：FPGA FPGA設計工業(yè)控制 1275 0

論工業(yè)控制系統(tǒng)的FPGA設計方法（2）

上次博文簡要介紹了人們研究使用FPGA來進行工業(yè)控制的驅動力與FPGA器件與工具的介紹，本次介紹FPGA設計方法論中的FPGA體系及其開發(fā)工具介紹。

2017-02-11 標簽：FPGA FPGA設計工業(yè)控制 1290 0

組合運用多種智能I/O規(guī)劃工具能使引腳分配過程變輕松

對于需要在PCB板上使用大規(guī)模FPGA器件的設計人員來說，I/O引腳分配是必須面對的眾多挑戰(zhàn)之一。

2017-02-11 標簽：FPGA 賽靈思 1946 0

FPGA與單片機實現(xiàn)數(shù)據(jù)串行通信的解決方案

本文針對由FPGA構成的高速數(shù)據(jù)采集系統(tǒng)數(shù)據(jù)處理能力弱的問題，提出FPGA與單片機實現(xiàn)數(shù)據(jù)串行通信的解決方案。

2017-02-11 標簽：FPGA 串行通信 1.2萬 0

初學者如何學習FPGA?

隨著半導體和嵌入式系統(tǒng)應用技術的高速發(fā)展，F(xiàn)PGA已經(jīng)被廣泛地應用于各行各業(yè)，無論是家用電器、智能玩具、數(shù)碼產(chǎn)品，還是通信行業(yè)、工業(yè)自動化、汽車電子、醫(yī)...

2017-02-11 標簽：FPGA FPGS 3099 0

ISE中下載Xilinx的bit文件失敗時的處理方案

在使用ISE進行FPGA的bit文件下載時，經(jīng)常會遇到下載失敗的問題，提示："DONE did not go high".

2017-02-11 標簽：FPGA Xilinx ISE 6790 0

FPGA與DSPs高速互聯(lián)的方案

DSP與FPGA高速的數(shù)據(jù)傳輸有三種常用接口方式: EMIF, HPI 和 McBSP 方式。而采用 EMIF 接口方式, 利用 FPGA ( 現(xiàn)場可編...

2017-02-11 標簽：FPGA DSPs 2831 0

解讀XILINX的7系列28nm FPGA封裝策略

買櫝還珠的故事，大家一定不陌生。如果把芯片內部最值錢和最有技術含量的那個硅片比喻為珍珠的話，芯片外面的封裝，包括管腳，就可以比喻為櫝了。

2017-02-11 標簽：FPGA 賽靈思 Xilinx 4134 0

有關復位信號時序約束問題

做了很久FPGA的朋友們，是否有這種經(jīng)歷：一個FPGA設計工程，在研發(fā)測試階段或轉產(chǎn)中試階段發(fā)現(xiàn)，F(xiàn)PGA系統(tǒng)在上電運行后，偶爾會有異?，F(xiàn)象？或者說，...

2017-02-11 標簽：FPGA 時序約束復位信號 7579 0

賽靈思FPGA設計技巧與應用創(chuàng)新

上一次我們提到可以利用本地存儲的訓練序列與接收到的序列進行匹配濾波（相關）的方法來搜尋精確的OFDM符號起始位置。

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賽靈思FPGA設計技巧與應用創(chuàng)新（二）

前面的博文中已經(jīng)提到了基于Sigma-Delta ADC采樣的數(shù)據(jù)采集系統(tǒng)，并詳細說了Sinc3抽樣濾波器的設計方法，在有詳細介紹。后來將前面的ADC也...

2017-02-11 標簽：FPGA FPGA設計賽靈思 1501 0

FPGA設計中對輸入信號的處理

一般來說，在全同步設計中，如果信號來自同一時鐘域，各模塊的輸入不需要寄存。只要滿足建立時間，保持時間的約束，可以保證在時鐘上升沿到來時，輸入信號已經(jīng)穩(wěn)定...

2017-02-11 標簽：FPGA FPGA設計全同步設計 3887 0

3系列FPGA中使用LUT構建分布式RAM(4)

前面講了分布式RAM的方方面面，下面以RAM_16S為例，分別給出其在VHDL和Verilog HDL下面的模板代碼（在ISE Project Navi...

2017-02-11 標簽：FPGA RAM LUT 1745 0

3系列FPGA中使用LUT構建分布式RAM（3）

前面簡要介紹了Spartan-3系列FPGA中分布式RAM的基本特性。為什么不從更高級的Virtex系列入手呢？我仔細看了一下各個系列的介紹、對比，Sp...

2017-02-11 標簽：FPGA RAM LUT 1412 0

3系列FPGA中使用LUT構建分布式RAM（1）

在賽靈思Spartan-3、3E等系列的FPGA中，其邏輯單元CLB中一般含有不同數(shù)量的單端口RAM（SRAM）或者雙端口RAM（DRAM），這里的“單...

2017-02-11 標簽：FPGA RAM LUT 7138 0

3系列FPGA中使用LUT構建分布式RAM（2）

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2017-02-11 標簽：FPGA RAM LUT 2597 0

工程師對于有關FPGA項目的九大感言

要和人配合。以我們做硬件的工程師為例，測試的時候一般都需要軟件的配合，一個對硬件來說無比復雜的工作，可能在軟件工程師看來就是幾行簡單的代碼。

2017-02-11 標簽：FPGA 1447 0

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