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標(biāo)簽 > fpga
FPGA(Field-Programmable Gate Array),即現(xiàn)場可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點。
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基于FPGA和硬件描述語言Verilog的液晶顯示控制器的設(shè)
本設(shè)計是一種基于FPGA(現(xiàn)場可編程門陣列)的液晶顯示控制器。與集成電路控制器相比,F(xiàn)PGA更加靈活,可以針對小同的液晶顯示模塊更改時序信號和顯示數(shù)據(jù)。...
FPGA的功耗高度依賴于用戶的設(shè)計,沒有哪種單一的方法能夠?qū)崿F(xiàn)這種功耗的降低,在進(jìn)行低功耗器件的設(shè)計時,人們必須仔細(xì)權(quán)衡性能、易用性、成本、密度以及功...
基于FPGA及RTOS操作系統(tǒng)的碼流分析儀設(shè)計
本文提出一種性價比較好的補充設(shè)計方案,它以通用的FPGA和RTOS為基礎(chǔ)、基于嵌入式硬件平臺來實現(xiàn)碼流分析功能。文中還闡述了碼流采集、碼流分析和信息顯示...
基于Flash構(gòu)架的模數(shù)混合的FPGA在心電監(jiān)控儀上的應(yīng)用設(shè)
Fution系列的FPGA是世界上首個基于Flash構(gòu)架的模數(shù)混合的FPGA,即在數(shù)字FPGA的基礎(chǔ)上加入了模擬電路部分,解決了傳統(tǒng)模擬電路和FPGA分...
本系統(tǒng)設(shè)計利用FPGA間接控制2塊MAX4312選通所需要的視頻通道,實現(xiàn)各個視頻通道間相互切換。根據(jù)開關(guān)控制信號的設(shè)計思想在FPGA中對撥動開關(guān)輸入信...
2010-06-29 標(biāo)簽:FPGA開關(guān)控制 4005 0
首先介紹了內(nèi)存條的工作原理,內(nèi)存條電路設(shè)計的注意事項,以及如何使用FPGA實現(xiàn)對DDR內(nèi)存條的控制,最后給出控制的仿真波形。 1 內(nèi)存條的工作原理&n...
DSP和FPGA設(shè)計的三相異步電機矢量伺服系統(tǒng)
隨著交流伺服控制理論的發(fā)展,交流伺服驅(qū)動已經(jīng)具有可與直流伺服驅(qū)動相比擬的性能,并且交流伺服傳動技術(shù)已廣泛
單片F(xiàn)PGA高清(HD)互聯(lián)網(wǎng)協(xié)議(IP)監(jiān)視攝像機設(shè)計方案
Altera公司日前發(fā)布業(yè)界第一款單片F(xiàn)PGA高清(HD)互聯(lián)網(wǎng)協(xié)議(IP)監(jiān)視攝像機參考設(shè)計,進(jìn)一步為監(jiān)視市場提供擴展FPGA解決方案。這一獨特的解決...
采用可編程邏輯器件和A/D轉(zhuǎn)換器的高速數(shù)據(jù)采集卡的設(shè)計方案
用于PC的采集系統(tǒng)以前大多有用ISA總線結(jié)構(gòu),這種結(jié)構(gòu)的最大缺點是傳輸速率低,無法實現(xiàn)高速數(shù)據(jù)的實時傳輸。而PCI總線則以其卓越的性能受到了廣泛的應(yīng)...
2010-06-25 標(biāo)簽:FPGA轉(zhuǎn)換器可編程邏輯器件 947 0
Stratix IV FPGA系列密度最大器件實現(xiàn)量產(chǎn)
Altera公司今天宣布,開始量產(chǎn)發(fā)售40-nm Stratix® IV FPGA系列密度最大的器件。Stratix IV E EP4SE820...
ARM920T基于Linux平臺下的FPGA驅(qū)動開發(fā)
Linux操作系統(tǒng)的全稱是GNU/Linux,它是由GNU工程和Linux內(nèi)核兩個部分共同組成的一個操作系統(tǒng)。該系統(tǒng)中所有組件的源代碼都是自由的,可以有...
Silego推出具有FPGA和模擬功能的小型定制IC SLG46200,GreenPAK定制IC SLG46200具有可配置的模擬元器件的一次性可編程m...
整合ARM、FPGA與可編程模擬電路設(shè)計的單芯片技術(shù)
如果世上真的有典型或者通用的嵌入式系統(tǒng)應(yīng)用,主流半導(dǎo)體公司的產(chǎn)品目錄一定會薄很多?,F(xiàn)在設(shè)計人員不僅要從多種處理器架構(gòu)中進(jìn)行選擇(大多數(shù)嵌入式系統(tǒng)設(shè)計都以處理器內(nèi)
FPGA開發(fā)基本流程包括:設(shè)計輸入、設(shè)計仿真、設(shè)計綜合、布局布線,它們的連接關(guān)系如圖1 所示。
2010-06-10 標(biāo)簽:FPGA 1796 0
對FPGA進(jìn)行系統(tǒng)設(shè)計的Xilinx軟件使用方法
Solution:在對FPGA設(shè)計進(jìn)行最初步的系統(tǒng)規(guī)劃的時候,需要進(jìn)行模塊劃分,模塊接口定義等工作。通常,我們只能在紙上進(jìn)行設(shè)計。雖然在紙上我們可以很隨...
DCM概述??? DCM內(nèi)部是DLL(Delay Lock Loop(?)結(jié)構(gòu),對時鐘偏移量的調(diào)節(jié)是通過長的延時線形成的。DCM的參數(shù)里有一個PHASE...
摘要:本文針對由FPGA構(gòu)成的高速數(shù)據(jù)采集系統(tǒng)數(shù)據(jù)處理能力弱的問題,提出FPGA與單片機實現(xiàn)數(shù)據(jù)串行通信的解決方案。在通信過程中完全遵守RS232協(xié)議,...
FPGA設(shè)計的SPI自動發(fā)送模塊技術(shù)
一、摘要: SPI 接口應(yīng)用十分廣泛,在很多情況下,人們會用軟件模擬的方法來產(chǎn)生SPI 時序或是采用帶SPI 功能模...
Altium在Altium Designer軟件內(nèi)新增Ald
Altium和Aldec日前簽署的OEM協(xié)議中決定將Aldec的FPGA仿真功能添加到Altium Designer軟件中去。 該協(xié)議的簽署使進(jìn)行FP...
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