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ip核

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IP就是知識產(chǎn)權(quán)核或知識產(chǎn)權(quán)模塊的意思，在EDA技術(shù)開發(fā)中具有十分重要的地位。美國著名的Dataquest咨詢公司將半導(dǎo)體產(chǎn)業(yè)的IP定義為“用于ASIC或FPGA中的預(yù)先設(shè)計好的電路功能模塊”。

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ip核技術(shù)

基于FPGA的UDP萬兆光通信測試

本文開源一個FPGA項目：UDP萬兆光通信。該項目實現(xiàn)了萬兆光纖以太網(wǎng)數(shù)據(jù)回環(huán)傳輸功能。Vivado工程代碼結(jié)構(gòu)和之前開源的《UDP RGMII千兆以太...

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基于AXI總線的DDR3讀寫測試

本文開源一個FPGA項目：基于AXI總線的DDR3讀寫。之前的一篇文章介紹了DDR3簡單用戶接口的讀寫方式：《DDR3讀寫測試》，如果在某些項目中，我們...

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基于FPGA搭建Micro Blaze最小系統(tǒng)

本文介紹一個FPGA 開源項目：Micro Blaze最小系統(tǒng)。MicroBlaze是Xilinx提供的一個軟核IP，該軟核是由FPGA片內(nèi)邏輯資源組成...

2023-09-01 標簽：fpga Xilinx MicroBlaze 3724 0

基于FPGA的UDP千兆以太網(wǎng)光通信

本文介紹一個FPGA開源項目：UDP千兆以太網(wǎng)光通信。利用SFP接口，可以通過使用SFP轉(zhuǎn)RJ45模塊或者直接使用光纖進行以太網(wǎng)通信。

2023-08-31 標簽：fpga 接口千兆以太網(wǎng) 5191 0

FPGA學(xué)習(xí)筆記：RAM IP核的使用方法

我們知道除了只讀存儲器外還有隨機存取存儲器，這一篇將介紹另一種存儲類IP核 ——RAM的使用方法。RAM是隨機存取存儲器（Random Acces...

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Vivado中BRAM IP的配置方式和使用技巧

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2023-08-29 標簽：fpga 寄存器 fifo 7708 0

DDS-IP核的理論知識和應(yīng)用案例

DDS，Director Digital Synthesis，直接頻率合成技術(shù)，是指通過固定頻率的參考時鐘（采樣時鐘）生成指定頻率的正余弦信號。采用FP...

2023-08-22 標簽：fpga 時鐘 DDS 6665 0

FPGA學(xué)習(xí)筆記：ROM IP核的使用方法

上一篇介紹了常用的鎖相環(huán)IP，這一節(jié)將介紹一種較為常用的存儲類IP核 ——ROM的使用方法。ROM是只讀存儲器（Read-Only Memory）...

2023-08-22 標簽：fpga 鎖相環(huán)存儲器 6157 0

FPGA學(xué)習(xí)筆記：PLL IP核的使用方法

IP（Intellectual Property）是知識產(chǎn)權(quán)的意思，半導(dǎo)體行業(yè)的IP是“用于ASIC或FPGA中的預(yù)先設(shè)計好的電路功能模塊”。一些常用的...

2023-08-22 標簽：fpga 半導(dǎo)體 FIFO 5969 0

學(xué)習(xí)FPGA新IP核的正確打開方式

FPGA開發(fā)過程中，利用各種IP核，可以快速完成功能開發(fā)，不需要花費大量時間重復(fù)造輪子。

2023-08-07 標簽：fpga Xilinx 時鐘 1229 0

FIFO的一些基礎(chǔ)知識

FPGA廠商提供了豐富的IP核，基礎(chǔ)性IP核都是可以直接免費調(diào)用的，比如FIFO、RAM等等。

2023-08-07 標簽：fpga fifo IP核 2771 0

如何在Vivado中配置FIFO IP核

Vivado IP核提供了強大的FIFO生成器，可以通過圖形化配置快速生成FIFO IP核。

2023-08-07 標簽：接口 fifo IP核 5262 0

使用IP核創(chuàng)建單時鐘FIFO

FIFO，先進先出。在FPGA中使用的FIFO一般是指對數(shù)據(jù)的存儲具有先進先出的緩沖器，F(xiàn)IFO與普通的存儲器的不同在于它沒有讀寫地址線。舉個例子，當F...

2023-07-23 標簽：傳感器 fifo 時鐘 932 0

FPGA零基礎(chǔ)學(xué)習(xí)之Vivado-FIFO使用教程

FIFO的英文全稱叫做First in First out，即先進先出。這也就決定了這個IP核的特殊性，先寫進去的數(shù)據(jù)優(yōu)先被讀出，所以，F(xiàn)IFO是不需要...

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FPGA常用運算模塊-乘加器

本文是本系列的第三篇，本文主要介紹FPGA常用運算模塊-乘加器，xilinx提供了相關(guān)的IP以便于用戶進行開發(fā)使用。

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Multi-scaler的裸機測試流程

Multi-Scaler是一個用于圖像縮放的視頻處理IP核，支持最多8路輸出，使用Memory接口，從源緩沖區(qū)讀取圖像，在H和V域進行縮放后寫入到目的緩...

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經(jīng)驗貼：ADI官方IP核與例程編譯指南

ADI的官方demo板整套快速設(shè)計是相當具有參考意義的，在購買官方開發(fā)板后，通過官方例程可以快速學(xué)習(xí)對應(yīng)AD/DA的使用方法。不僅如此，ADI官方的IP...

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在FPGA中利用CORDIC算法IP核實現(xiàn)三角函數(shù)關(guān)系的轉(zhuǎn)換

在FPGA硬件實現(xiàn)CORDIC的邏輯其實是很簡單的，就是設(shè)置好輸入輸出的位寬，然后建立好對應(yīng)的精度表，通過旋轉(zhuǎn)加得到運算結(jié)果。

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DDR3約束規(guī)則與IP核時鐘需求

FPGA端掛載DDR時，對FPGA引腳的約束和選擇并不是隨意的，有一定的約束規(guī)則，一般可以通過利用vivado工具中的pin assignment去選擇...

2022-07-03 標簽：fpga DDR3 Xilinx 5103 0

如何實現(xiàn)PCIE的發(fā)送和接收數(shù)據(jù)

本工程的目的是在XC7K325tffg的平臺上實現(xiàn)pcie的數(shù)據(jù)發(fā)送和接收，速率8通道2.5GB/s,首先看下本工程的PCIE部分的結(jié)構(gòu)。

2022-04-21 標簽：PCIe IP核接收數(shù)據(jù) 4278 0

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　　SDK一般指軟件開發(fā)工具包，軟件開發(fā)工具包一般都是一些軟件工程師為特定的軟件包、軟件框架、硬件平臺、操作系統(tǒng)等建立應(yīng)用軟件時的開發(fā)工具的集合。軟件開發(fā)工具廣義上指輔助開發(fā)某一類軟件的相關(guān)文檔、范例和工具的集合。
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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進行靜電中和等。
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OBD是英文On-Board Diagnostic的縮寫，中文翻譯為“車載診斷系統(tǒng)”。這個系統(tǒng)隨時監(jiān)控發(fā)動機的運行狀況和尾氣后處理系統(tǒng)的工作狀態(tài)，一旦發(fā)現(xiàn)有可能引起排放超標的情況，會馬上發(fā)出警示。

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