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標簽 > ip核
IP就是知識產(chǎn)權(quán)核或知識產(chǎn)權(quán)模塊的意思,在EDA技術(shù)開發(fā)中具有十分重要的地位。美國著名的Dataquest咨詢公司將半導體產(chǎn)業(yè)的IP定義為“用于ASIC或FPGA中的預先設計好的電路功能模塊”。
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系統(tǒng)設計工程師不可不知的DRAM控制器核心結(jié)論
電子發(fā)燒友網(wǎng)核心提示: DRAM控制器藏在您的系統(tǒng)核心芯片系統(tǒng)(SoC)中,可能有兩個,甚至是四個。有一些精心制作的邏輯小模塊,用于連接SoC內(nèi)部和外部...
TFT液晶顯示器(LCD)具有功耗低、體積小、工作電壓低、使用壽命長、可以顯示復雜的文字及彩色圖像等優(yōu)點,在嵌入式設備中得到了廣泛的應用,成為人機交互的...
隨著電路規(guī)模不斷擴大,以及競爭帶來的上市時間的壓力,越來越多的電路設計者開始利用設計良好的、經(jīng)反復驗證的電路功能模塊來加快設計進程。這些電路功能模塊被稱...
基于快速傅里葉IP核的數(shù)字脈壓處理器的實現(xiàn)
本文基于快速傅里葉IP核可復用和重配置的特點,實現(xiàn)一種頻域的FPGA數(shù)字脈壓處理器,能夠完成正交輸入的可變點LFM信號脈沖壓縮,具有設計靈活,調(diào)試方便,...
基于Altera浮點IP核的浮點矩陣相乘運算的實現(xiàn)和改進設計
嵌入式計算作為新一代計算系統(tǒng)的高效運行方式,應用于多個高性能領(lǐng)域,如陣列信號處理、核武器模擬、計算流體動力學等。在這些科學計算中,需要大量的浮點矩陣運算...
Altera以太網(wǎng)路IP核心 降低FPGA設計難度
Altera推出40Gbit/s以太網(wǎng)路(40GbE)和100Gbit/s以太網(wǎng)路(100GbE)矽智財(IP)核心產(chǎn)品。這些核心能高效率的建構(gòu)需大傳輸...
TAKUMI公司:圖象IP核參考設計可用于S2C原型驗證平臺
電子發(fā)燒友網(wǎng)訊: 本文主要講述了TAKUMI公司的圖象IP核參考設計可用于S2C原型驗證平臺。S2C宣布,一家總部位于日本的高級圖形知識產(chǎn)權(quán)(IP)供應...
目前過兩個關(guān)鍵因素影響網(wǎng)絡協(xié)議棧的開發(fā),一是性能和效率,二是開發(fā)調(diào)試方便。傳統(tǒng)的操作系統(tǒng)一般只能顧及其中的一個方面。例如在Linux、FreeBSD中,...
FPGA的高速多通道數(shù)據(jù)采集控制器IP核設計
隨著可編程邏輯器件的不斷進步和發(fā)展,F(xiàn)PGA在嵌入式系統(tǒng)中發(fā)揮著越來越重要的作用。本文介紹的在電能質(zhì)量監(jiān)測系統(tǒng)中信號采集模塊控制器的 IP核,是采用硬...
2012-05-22 標簽:FPGA控制器數(shù)據(jù)采集 1584 0
MC8051是與MCS一5l系列微處理器指令集完全兼容的8位嵌入式微處理器,通過芯核重用技術(shù),可廣泛應用在一些面積要求比較苛刻,而對速度要求不是很高的片...
2012-05-22 標簽:IP核VHDL源代碼MC8051微處理器 7542 0
本文利用Altera公司的FPGA開發(fā)工具對皋于國產(chǎn)龍芯I號處理器IP核的SoC芯片進行ASIC流片前的系統(tǒng)驗證,全實時方式運行協(xié)同設計所產(chǎn)生的硬件代碼...
本文將從Leon2的結(jié)構(gòu)、技術(shù)特點、軟硬件的開發(fā)過程和應用實例等四個方面進行介紹。在技術(shù)特點中,主要介紹了它所遵循的SPARCV8規(guī)范、采用的AMBH2...
基于Altera ASI IP核的ASI發(fā)送卡實現(xiàn)
設計實現(xiàn)基于PC 機和ASI 接口標準的電視 節(jié)目傳輸流的收發(fā)設備,在節(jié)目的制作、保存和重播等方面有大量的應用。
基于FPGA和IP Core的定制緩沖管理的實現(xiàn)
隨著通信協(xié)議的發(fā)展及多樣化,協(xié)議處理部分PE在硬件轉(zhuǎn)發(fā)實現(xiàn)方面,普遍采用現(xiàn)有的商用芯片NP(Network Processor,網(wǎng)絡處理器)來完成,流量...
DDR3存儲器接口控制器IP核在視頻數(shù)據(jù)處理中的應用
DDR3存儲器系統(tǒng)可以大大提升各種數(shù)據(jù)處理應用的性能。然而,和過去幾代(DDR和DDR2)器件相比,DDR3存儲器器件有了一些新的要求。為了充分利用和...
基于FPGA的8段數(shù)碼管動態(tài)顯示IP核設計
基于FPGA的8段數(shù)碼管動態(tài)顯示IP核設計 引言 數(shù)碼管可顯示簡單的字符和數(shù)字,由于其價格低廉、性能穩(wěn)定、顯示清晰、亮度高、使用電
在測控系統(tǒng)中用IP核實現(xiàn)D/A轉(zhuǎn)換
摘要:采用數(shù)字化技術(shù)、在測控系統(tǒng)中用IP核實現(xiàn)D/A轉(zhuǎn)換,并且在1片可編程邏輯器件中實現(xiàn)。它不受溫度的影響,既可保持高分辨率,又可降低對電路精度和穩(wěn)
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