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標(biāo)簽 > serdes
SERDES是（串行器）/（解串器）的簡(jiǎn)稱。它是一種主流的時(shí)分多路復(fù)用（TDM）、點(diǎn)對(duì)點(diǎn)（P2P）的串行通信技術(shù)。
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接收端均衡器的目標(biāo)和發(fā)送均衡器是一致的。對(duì)于低速(<5Gbps)SerDes，通常采用連續(xù)時(shí)間域，線性均衡器實(shí)現(xiàn)如尖峰放大器(peaking am...
FPGA發(fā)展到今天，SerDes（Serializer-Deserializer）基本上是器件的標(biāo)配了。從PCI發(fā)展到PCI-E，從ATA發(fā)展到SATA...
Xilinx公司的許多FPGA已經(jīng)內(nèi)置了一個(gè)或多個(gè)MGT（Multi-Gigabit Transceiver）收發(fā)器，也叫做SERDES（Multi-G...
2023-07-29 標(biāo)簽：收發(fā)器SerDes大數(shù)據(jù) 1301 0
什么是SerDes？SerDes的應(yīng)用場(chǎng)景又是什么呢？
首先我們要了解什么是SerDes，SerDes的應(yīng)用場(chǎng)景又是什么呢？SerDes又有哪些常見的種類？
詳細(xì)討論SERDES用到的各種關(guān)鍵技術(shù)
隨著大數(shù)據(jù)的興起以及信息技術(shù)的快速發(fā)展，數(shù)據(jù)傳輸對(duì)總線帶寬的要求越來越高，并行傳輸技術(shù)的發(fā)展受到了時(shí)序同步困難、信號(hào)偏移嚴(yán)重，抗干擾能力弱以及設(shè)計(jì)復(fù)雜度...
2023-05-10 標(biāo)簽：收發(fā)器濾波器FPGA設(shè)計(jì) 2221 0
FPGA技術(shù)：SerDes是怎么設(shè)計(jì)的
利用源同步接口，數(shù)據(jù)的有效窗口可以提高很多。通常頻率都在1GHz以下。在實(shí)際應(yīng)用中可以見到如SPI4.2接口的時(shí)鐘可以高達(dá)DDR 700MHz x 16...
深度解讀SerDes（Serializer-Deserializer）3
對(duì)于高速SerDes的仿真需要借助統(tǒng)計(jì)分析 (statistical analysis) 的方法。統(tǒng)計(jì)分析的方法把發(fā)送端-信道-接收端的連接近視為線性系...
深度解讀SerDes（Serializer-Deserializer）1
FPGA發(fā)展到今天，SerDes（Serializer-Deserializer）基本上是器件的標(biāo)配了。從PCI發(fā)展到PCI-E，從ATA發(fā)展到SATA...
在過去的幾十年里，電子通信行業(yè)一直是 FPGA 市場(chǎng)增長(zhǎng)背后的重要推動(dòng)力，并將繼續(xù)保持下去。
在過去的幾十年里，電子通信行業(yè)一直是 FPGA 市場(chǎng)增長(zhǎng)背后的重要推動(dòng)力，并將繼續(xù)保持下去。這背后的一個(gè)主要原因是 FPGA 中內(nèi)置了許多不同的高速接口...
此外，這些并行數(shù)據(jù)線中的每一條都不僅僅是布局和布線人員所關(guān)心的問題。緊密間隔的電線或 PCB 跡線（如圖 2 所示）容易受到串?dāng)_的影響，尤其是數(shù)字信號(hào)的...
SerDes 是空間到時(shí)間到空間的轉(zhuǎn)換。并行數(shù)據(jù)同時(shí)傳輸?shù)加貌煌奈锢砘ミB，串行數(shù)據(jù)共享相同的物理空間但占用不同的時(shí)間時(shí)刻
由于傳輸線的時(shí)延不一致和抖動(dòng)存在，接收端不能正確的采樣數(shù)據(jù)，對(duì)不準(zhǔn)眼圖中點(diǎn)。 然后就想到了從數(shù)據(jù)里面恢復(fù)出時(shí)鐘去采樣數(shù)據(jù)，即CDR
FPGA發(fā)展到今天，SerDes(Serializer-Deserializer)基本上是標(biāo)配了。
本篇文章主要是對(duì)前兩種常用的千兆網(wǎng)接口的介紹，以直觀的方式對(duì)比這兩種接口在引腳方面的不同，比較適合幫助初學(xué)者建立一個(gè)初步的印象，能夠快速的了解RGMII...
但是，在內(nèi)部處理信號(hào)時(shí)，數(shù)據(jù)信號(hào)往往是多bit信號(hào)，而傳輸過程中需要用到單bit串行傳輸技術(shù)，所以，中間需要有一個(gè)轉(zhuǎn)換器，實(shí)現(xiàn)并串轉(zhuǎn)換，這就需要用到SE...
2022-08-20 標(biāo)簽：fpga轉(zhuǎn)換器DDR 5511 0
SERDES的引腳數(shù)量和通道優(yōu)勢(shì)
SERDES最明顯的優(yōu)勢(shì)是具備更少的引腳數(shù)量和線纜/通道數(shù)量。對(duì)于早期的SERDES，這意味著數(shù)據(jù)可以通過同軸電纜或光纖發(fā)送。
2022-07-22 標(biāo)簽：數(shù)據(jù)引腳SerDes 4058 0
等長(zhǎng)對(duì)我們信號(hào)質(zhì)量有什么影響？
SERDES信號(hào)都是由差分傳輸?shù)?，也就是說，兩根信號(hào)線同時(shí)傳輸兩個(gè)大小相等，方向相反的信號(hào)，接收端接收到的信號(hào)由兩線相減得來。
做過layout的朋友一定會(huì)有一種這樣的感覺，串行通道恐怕是最容易設(shè)計(jì)的部分了。通道就一對(duì)差分線，芯片端串行部分信號(hào)pin的密度都相對(duì)低，出線也十分簡(jiǎn)單...
基于LS1046A&LS1028A的飛凌嵌入式平臺(tái)的SerDes資源分配解析
目前我們已經(jīng)發(fā)布了NXP的QorIQLS架構(gòu)系列的幾款平臺(tái)，包含LS1046A、LS1043A、LS1028A、LS1012A。這幾款平臺(tái)都原生支持網(wǎng)口...
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