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soc設(shè)計(jì)

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soc設(shè)計(jì)技術(shù)

聊一聊無毛刺時(shí)鐘切換的問題

先說為什么要做clock switching，在現(xiàn)代的SoC設(shè)計(jì)中，很多時(shí)候我們設(shè)計(jì)的模塊并不是要跑在一個(gè)固定的頻率下，而是根據(jù)性能和功耗的要求要跑在不...

2023-06-27 標(biāo)簽：分頻器 SoC設(shè)計(jì)CDC技術(shù) 2053 0

Top和Block實(shí)戰(zhàn)經(jīng)驗(yàn)以及DDR接口時(shí)序

IO約束在頂層和模塊級(jí)的主要命令都是以下幾個(gè)，但是實(shí)際應(yīng)用的復(fù)雜程度不可同日而語，本篇會(huì)先介紹模塊級(jí)IO約束實(shí)戰(zhàn)經(jīng)驗(yàn)，然后講解頂層IO約束復(fù)雜性，過程中...

2023-06-27 標(biāo)簽：寄存器 SoC設(shè)計(jì)輸入電容 1305 0

跨時(shí)鐘域電路設(shè)計(jì)—單比特信號(hào)傳輸

跨時(shí)鐘域（CDC）的應(yīng)從對(duì)亞穩(wěn)定性和同步性的基本了解開始。

2023-06-27 標(biāo)簽：SoC設(shè)計(jì)MTBF CDC 1353 0

Net Delay在整個(gè)路徑延時(shí)的占比是什么情況呢？

繞線延時(shí)（Net Delay）是怎么計(jì)算出來的呢？Net Delay在整個(gè)路徑延時(shí)（Path Delay）的占比又是什么情況呢？針對(duì)關(guān)鍵路徑，工具會(huì)如何...

2023-06-27 標(biāo)簽：EDA工具 SoC設(shè)計(jì)DFM 2737 0

芯片設(shè)計(jì)進(jìn)階之路—低功耗深入理解

低功耗芯片設(shè)計(jì)是本世紀(jì)以來最重要的新興設(shè)計(jì)方法?？梢哉f沒有低功耗設(shè)計(jì)，就沒有今天的智能手機(jī)，移動(dòng)設(shè)備，物聯(lián)網(wǎng)，及高性能計(jì)算等產(chǎn)業(yè)。

2023-06-21 標(biāo)簽：處理器 SOC設(shè)計(jì)晶體管 3838 0

芯片設(shè)計(jì)中跨時(shí)鐘域CDC的那些事

這里我們先復(fù)習(xí)一下同步電路和異步電路的概念。在現(xiàn)代SoC設(shè)計(jì)中，絕大多數(shù)的電路都是同步電路。

2023-06-20 標(biāo)簽：EDA工具 SoC設(shè)計(jì)鎖存器 2332 0

SoC設(shè)計(jì)之功耗—IR drop

SoC電源/地網(wǎng)絡(luò)給整個(gè)芯片供電，一個(gè)設(shè)計(jì)合理的電源/地網(wǎng)絡(luò)要保證整個(gè)芯片的性能和可靠性。

2023-06-16 標(biāo)簽：SoC設(shè)計(jì)計(jì)數(shù)器電源電壓 2922 0

多片F(xiàn)PGA原型的兩種分割方式介紹

綜合工具的任務(wù)是將SoC設(shè)計(jì)映射到可用的FPGA資源中。自動(dòng)化程度越高，構(gòu)建基于FPGA的原型的過程就越容易、越快。

2023-06-13 標(biāo)簽：fpga RAM SoC設(shè)計(jì) 652 0

SOC的多核啟動(dòng)流程和概念詳解

本文以為armv8-aarch64、armv9為例、TF-A代碼為例，不討論其它硬件架構(gòu)和固件軟件中的設(shè)計(jì)。

2023-06-08 標(biāo)簽：寄存器 SoC設(shè)計(jì)ARM處理器 2499 0

系統(tǒng)芯片與晶片測試

系統(tǒng)芯片 (Sxstem on Chip，SoC）通過軟硬件結(jié)合的設(shè)計(jì)和驗(yàn)證方法

2023-06-07 標(biāo)簽：邏輯電路存儲(chǔ)器微處理器 928 0

使用ARM設(shè)計(jì)SOC開機(jī)/Reset后的第一條指令是啥？

aarch64 boot address 是允許設(shè)置的，軟件可配，根據(jù)信號(hào)RVBARADDR 具體設(shè)計(jì)而定

2023-06-06 標(biāo)簽：arm SoC設(shè)計(jì)ARM處理器 1229 0

動(dòng)力電池衰減的原因有哪些

在鋰電池中，有一層交換膜，鋰離子來回穿過這層膜完成充電放電。

2023-06-06 標(biāo)簽：鋰離子電池鋰電池動(dòng)力電池 2227 0

輸入一個(gè)URL

輸入網(wǎng)址嘛，那就是鍵盤輸入了，鍵盤一般用usb或者PS/2口連接電腦，現(xiàn)在見過PS/2口的人不多了吧，我們就看看usb吧，usb分為主從模式，一般的鍵盤...

2023-06-05 標(biāo)簽：USB接口 USB控制器 SoC設(shè)計(jì) 661 0

MCU是否會(huì)從ADAS域控制器消失呢？

ADAS一般由功能安全MCU和大算力SoC組成，SoC負(fù)責(zé)傳感器數(shù)據(jù)融合，跑算法模型，執(zhí)行計(jì)算

2023-06-02 標(biāo)簽：傳感器神經(jīng)網(wǎng)絡(luò)SoC設(shè)計(jì) 864 0

分享一個(gè)coverage merge小技巧

在下面代碼里面有三個(gè)實(shí)例，分別是dut，cnt1，cnt2.

2023-06-01 標(biāo)簽：SoC設(shè)計(jì)Merge模式 1426 0

AMBA向多芯片和CHI C2C進(jìn)發(fā)

Arm的Advanced Microcontroller Bus Architecture（AMBA）在與生態(tài)系統(tǒng)合作解決復(fù)雜的行業(yè)性問題方面有著悠久的歷史。

2023-05-29 標(biāo)簽：控制器存儲(chǔ)器 AMBA總線 2090 0

FPGA原型平臺(tái)門控時(shí)鐘自動(dòng)轉(zhuǎn)換

現(xiàn)代FPGA綜合工具會(huì)自動(dòng)執(zhí)行門控時(shí)鐘轉(zhuǎn)換，而無需更改RTL代碼中的設(shè)計(jì)，然而，我們可能需要適當(dāng)?shù)厥謩?dòng)指導(dǎo)綜合工具執(zhí)行門控時(shí)鐘變換。

2023-05-23 標(biāo)簽：時(shí)鐘緩沖器 SoC設(shè)計(jì)RTL 2251 0

多片F(xiàn)PGA的原型驗(yàn)證系統(tǒng)的性能和容量通常受到FPGA間連接的限制。FPGA中有大量的資源，但I(xiàn)O引腳的數(shù)量受封裝技術(shù)的限制，通常只有1000個(gè)左右的用...

2023-05-23 標(biāo)簽：連接器交換機(jī)SoC設(shè)計(jì) 1806 0

淺析FPGA原型驗(yàn)證系統(tǒng)的時(shí)鐘資源

如果SoC設(shè)計(jì)規(guī)模小，在單個(gè)FPGA內(nèi)可以容納，那么只要系統(tǒng)中的FPGA具有所SoC所設(shè)計(jì)需要時(shí)鐘的數(shù)量

2023-05-23 標(biāo)簽：fpga pll SoC設(shè)計(jì) 1082 0

正確認(rèn)識(shí)原型驗(yàn)證多片F(xiàn)PGA自動(dòng)分割工具

當(dāng)SoC的規(guī)模在一片F(xiàn)PGA中裝不下的時(shí)候，我們通常選擇多片F(xiàn)PGA原型驗(yàn)證的平臺(tái)來承載整個(gè)SoC系統(tǒng)。

2023-05-23 標(biāo)簽：存儲(chǔ)器 SoC設(shè)計(jì)FPGA開發(fā)板 763 0

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Protues

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Proteus軟件是英國Lab Center Electronics公司出版的EDA工具軟件（該軟件中國總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

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FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
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FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過去汽車電子產(chǎn)品的開發(fā)周期是漫長的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長寬，直插，貼片，焊盤的大小，管腳的長寬，管腳的間距等）用圖形方式表現(xiàn)出來，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
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Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場領(lǐng)域。
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面包板

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面包板是由于板子上有很多小插孔，專為電子電路的無焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
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時(shí)鐘源用來為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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