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      標(biāo)簽　>　verilog

      verilog

      +關(guān)注29人關(guān)注

      Verilog HDL是一種硬件描述語(yǔ)言（HDL:Hardware Description Language），以文本形式來(lái)描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為的語(yǔ)言，用它可以表示邏輯電路圖、邏輯表達(dá)式，還可以表示數(shù)字邏輯系統(tǒng)所完成的邏輯功能。

      文章：708個(gè) 瀏覽：112043次 帖子：937個(gè)

      verilog資訊

      verilog PS2鍵盤(pán)解碼程序

       之前探討過(guò)PS/2鍵盤(pán)編解碼以及數(shù)據(jù)傳輸協(xié)議，這次自己動(dòng)手實(shí)現(xiàn)了利用FPGA接收鍵盤(pán)編碼，然后通過(guò)串口傳輸?shù)絇C。做的比較

      2010-06-05 標(biāo)簽：PSverilog 2289 0

      好用的Verilog串口UART程序

      ==========================================================================//...

      2010-06-05 標(biāo)簽：Veriloguart 6453 1

      怎樣實(shí)現(xiàn)Verilog模擬PS2協(xié)議

      怎樣實(shí)現(xiàn)Verilog模擬PS2協(xié)議

      PS2協(xié)議讀鍵盤(pán)值相當(dāng)簡(jiǎn)單嘛，比模擬SPI、I2C簡(jiǎn)單多了...下面介紹一下具體過(guò)程. 1.明確接線關(guān)系，只需接4根線，VCC要+5V，3.3我測(cè)試過(guò)...

      2010-06-05 標(biāo)簽：PSVerilog 1936 0

      VHDL和Verilog HDL語(yǔ)言對(duì)比

      VHDL和Verilog HDL語(yǔ)言對(duì)比 Verilog HDL和VHDL都是用于邏輯設(shè)計(jì)的硬件描述語(yǔ)言，并且都已成為IEEE標(biāo)準(zhǔn)。VHDL是在198...

      2010-02-09 標(biāo)簽：VerilogHDLVHDL 1.1萬(wàn) 0

      Verilog HDL語(yǔ)言簡(jiǎn)介

      Verilog HDL語(yǔ)言簡(jiǎn)介 1．什么是Verilog HDLVerilog HDL是硬件描述語(yǔ)言的一種，用于數(shù)

      2010-02-09 標(biāo)簽：verilog 4034 0

      Verilog HDL語(yǔ)言實(shí)現(xiàn)時(shí)序邏輯電路

      Verilog HDL語(yǔ)言實(shí)現(xiàn)時(shí)序邏輯電路 在Verilog HDL語(yǔ)言中，時(shí)序邏輯電路使用always語(yǔ)句塊來(lái)實(shí)現(xiàn)。例如，實(shí)現(xiàn)一個(gè)帶有異步復(fù)位信號(hào)的D觸發(fā)器

      2010-02-08 標(biāo)簽：HDVerilog 4901 0

      基于Verilog的順序狀態(tài)邏輯FSM的設(shè)計(jì)與仿真

      基于Verilog的順序狀態(tài)邏輯FSM的設(shè)計(jì)與仿真

      基于Verilog的順序狀態(tài)邏輯FSM的設(shè)計(jì)與仿真 　硬件描述語(yǔ)言Verilog為數(shù)字系統(tǒng)設(shè)計(jì)人員提供了一種在廣泛抽象層次上描述數(shù)字系統(tǒng)的方式，同時(shí)，...

      2010-02-04 標(biāo)簽：VerilogFS 2018 0

      針對(duì)C語(yǔ)言編程者的Verilog開(kāi)發(fā)指南實(shí)例

      針對(duì)C語(yǔ)言編程者的Verilog開(kāi)發(fā)指南實(shí)例 本文舉例說(shuō)明了如何用軟件實(shí)現(xiàn)脈寬調(diào)制(PWM)，如何將該設(shè)計(jì)轉(zhuǎn)換成一個(gè)可以在FPGA中運(yùn)行的邏輯塊，并能利用

      2009-12-27 標(biāo)簽：Verilog 1060 0

      H.264/AVC中量化的Verilog方法介紹及實(shí)現(xiàn)

      H.264/AVC中量化的Verilog方法介紹及實(shí)現(xiàn)

      H.264/AVC中量化的Verilog方法介紹及實(shí)現(xiàn) 0  引  言 　　H.264作為新一代的視頻壓縮標(biāo)準(zhǔn)，是由ITU-T...

      2009-11-12 標(biāo)簽：Verilog 1177 0

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      ST-BUS總線接口模塊的Verilog HDL設(shè)計(jì) ST-BUS是廣泛應(yīng)用于E1通信設(shè)備內(nèi)部的一種模塊間通信總線。結(jié)合某專(zhuān)用通信系統(tǒng)E1接口轉(zhuǎn)換板的...

      2009-09-26 標(biāo)簽：HDVerilog 2545 0

      基于Verilog-HDL的軸承振動(dòng)噪聲電壓峰值檢測(cè)

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      摘要：介紹模擬峰值電壓的檢測(cè)方式，敘述基于Verilog-HDL與高速A/D轉(zhuǎn)換器相結(jié)合所實(shí)現(xiàn)的數(shù)字式快速軸承噪聲檢測(cè)方法，給出相關(guān)的Verilog-H...

      2009-06-20 標(biāo)簽：Verilog 1084 0

      基于Verilog HDL設(shè)計(jì)的自動(dòng)數(shù)據(jù)采集系統(tǒng)

      基于Verilog HDL設(shè)計(jì)的自動(dòng)數(shù)據(jù)采集系統(tǒng)

      摘要： 介紹了一種采用硬件控制的自動(dòng)數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)方法，包括數(shù)字系統(tǒng)自頂向下的設(shè)計(jì)思路、Verilog HDL對(duì)系統(tǒng)硬件的描述和狀態(tài)機(jī)的設(shè)計(jì)以及MA...

      2009-06-20 標(biāo)簽：Veriloghdl 1445 0

      基于Verilog HDL的CMOS圖像敏感器驅(qū)動(dòng)電路設(shè)計(jì)

      基于Verilog HDL的CMOS圖像敏感器驅(qū)動(dòng)電路設(shè)計(jì)

      摘要： 介紹一種用于衛(wèi)星姿態(tài)測(cè)量的CMOS圖像敏感器--STAR250的時(shí)序驅(qū)動(dòng)信號(hào)，并使用Verilog HDL語(yǔ)言設(shè)計(jì)驅(qū)動(dòng)時(shí)序電路。經(jīng)布線、仿真、測(cè)...

      2009-06-20 標(biāo)簽：Veriloghdl 938 0

      Verilog HDL語(yǔ)言在FPGA/CPLD開(kāi)發(fā)中的應(yīng)用

      Verilog HDL語(yǔ)言在FPGA/CPLD開(kāi)發(fā)中的應(yīng)用

      摘 要：通過(guò)設(shè)計(jì)實(shí)例詳細(xì)介紹了用Verilog HDL語(yǔ)言開(kāi)發(fā)FPGA/CPLD的方法，并通過(guò)與其他各種輸入方式的比較，顯示出使用Verilog HDL...

      2009-06-20 標(biāo)簽：fpgaVerilog 2131 0

      什么是Verilog HDL？

      什么是Verilog HDL？

      什么是Verilog HDL？ Verilog HDL是一種硬件描述語(yǔ)言，用于從算法級(jí)、門(mén)級(jí)到開(kāi)關(guān)級(jí)的多種抽象設(shè)計(jì)層次的數(shù)字系統(tǒng)建模。被建模的數(shù)字系統(tǒng)

      2009-01-18 標(biāo)簽：Verilog 4326 0

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        Protues
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        Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
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        為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
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      • FPGA芯片
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        FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
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        面包板是由于板子上有很多小插孔，專(zhuān)為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
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        +關(guān)注
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        特性阻抗又稱(chēng)特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱(chēng)阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
      • 時(shí)鐘源
        時(shí)鐘源
        +關(guān)注
        時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英 晶體振蕩器和與非門(mén)組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
      • AD采樣
        AD采樣
        +關(guān)注
        　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
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        驅(qū)動(dòng)電流
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      • Kintex-7
        Kintex-7
        +關(guān)注
        　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
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      編輯推薦廠商產(chǎn)品技術(shù)軟件/工具OS/語(yǔ)言教程專(zhuān)題

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