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Vitis Model Composer 是一款 Xilinx 工具包，支持在 MATALB? 和 Simulink? 環(huán)境中進(jìn)行快速設(shè)計(jì)探索和驗(yàn)證，并加速 Xilinx 器件的量產(chǎn)。

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vitis技術(shù)

如何在AMD Vitis Unified 2024.2中連接到QEMU

在本篇文章我們將學(xué)習(xí)如何在 AMD Vitis Unified 2024.2 中連接到 QEMU。這是本系列的第 2 篇博文。要了解如何設(shè)置和使用 Q...

2025-08-06 標(biāo)簽：amd 仿真 Unified 1.3k 0

使用AMD Vitis Unified IDE創(chuàng)建HLS組件

這篇文章在開(kāi)發(fā)者分享｜AMD Vitis HLS 系列 1 - AMD Vivado IP 流程（Vitis 傳統(tǒng) IDE）的基礎(chǔ)上撰寫(xiě)，但使用的是 ...

2025-06-20 標(biāo)簽：amd 嵌入式 Vivado 1.6k 0

如何使用AMD Vitis HLS創(chuàng)建HLS IP

本文逐步演示了如何使用 AMD Vitis HLS 來(lái)創(chuàng)建一個(gè) HLS IP，通過(guò) AXI4 接口從存儲(chǔ)器讀取數(shù)據(jù)、執(zhí)行簡(jiǎn)單的數(shù)學(xué)運(yùn)算，然后將數(shù)據(jù)寫(xiě)回存...

2025-06-13 標(biāo)簽：amd 接口 Vivado 1.1k 0

使用AMD Vitis進(jìn)行嵌入式設(shè)計(jì)開(kāi)發(fā)用戶(hù)指南

由于篇幅有限，本文僅選取部分內(nèi)容進(jìn)行分享。 Vitis 簡(jiǎn)介 AMD Vitis 工具套件包含多種設(shè)計(jì)技術(shù)，用于開(kāi)發(fā)以 AMD 器件（例如，AMD Ve...

2025-01-08 標(biāo)簽：amd 嵌入式設(shè)計(jì)Vitis 1.9k 0

如何優(yōu)化HLS仿真腳本運(yùn)行時(shí)間

需求：由于自己目前一個(gè) HLS 仿真腳本需要運(yùn)行 1個(gè)多小時(shí)，先打算通過(guò)打印時(shí)間戳的方式找出最耗時(shí)的部分，然后想辦法優(yōu)化。

2024-02-23 標(biāo)簽：函數(shù)C++代碼 1.3k 0

Vitis加速庫(kù)：廣泛且性能優(yōu)化的開(kāi)源庫(kù)

Vitis 統(tǒng)一軟件平臺(tái)包括一組廣泛的、性能優(yōu)化的開(kāi)源庫(kù)，這些庫(kù)提供了即開(kāi)即用的加速功能，并且對(duì)現(xiàn)有應(yīng)用實(shí)現(xiàn)最小化代碼更改或零更改。

2023-10-30 標(biāo)簽：編程語(yǔ)言數(shù)據(jù)分析 Vitis 1.3k 0

Vitis AI Library體驗(yàn)之OCR識(shí)別

Vitis AI Library是一組高層次庫(kù)和 API，專(zhuān)為利用 DPU 高效執(zhí)行 AI 推斷而構(gòu)建。它是基于 Vitis AI運(yùn)行時(shí)利用 Vitis...

2023-10-17 標(biāo)簽：神經(jīng)網(wǎng)絡(luò)AI OCR 1.7k 0

如何使用Vitis-AI加速YOLOX模型實(shí)現(xiàn)視頻中的目標(biāo)檢測(cè)

本文將介紹如何使用Vitis-AI加速YOLOX模型實(shí)現(xiàn)視頻中的目標(biāo)檢測(cè)，并對(duì)相關(guān)源碼進(jìn)行解讀。由于演示的示例程序源碼是Vitis-AI開(kāi)源項(xiàng)目提供的，...

2023-10-16 標(biāo)簽：AI DPU 模型 2.2k 0

基于Vitis AI的ADAS目標(biāo)識(shí)別

Vitis? AI開(kāi)發(fā)環(huán)境可在賽靈思硬件平臺(tái)上加速 AI 推斷，包括邊緣器件和 Alveo? 加速器卡。此環(huán)境由經(jīng)過(guò)最優(yōu)化的 IP 核、工具、庫(kù)、模型和...

2023-09-28 標(biāo)簽：AI adas 開(kāi)發(fā)環(huán)境 4.3k 0

KV260視覺(jué)入門(mén)套件smartcamera體驗(yàn)

2023-09-11 標(biāo)簽：usb 攝像頭 AI 5.1k 0

如何獲取和使用Github上的Vitis開(kāi)放資源

自從 Vitis 的發(fā)布，AMD 在 Github 上也開(kāi)源了很多資源，方便開(kāi)發(fā)者進(jìn)行自己的設(shè)計(jì)，減少產(chǎn)品上市時(shí)間。所以我們來(lái)看一下如何獲取和使用 Gi...

2023-08-23 標(biāo)簽：amd Xilinx 開(kāi)源 1.7k 0

Vitis HLS相關(guān)問(wèn)答詳解

需要手工在 C++ 代碼里明確指定可并行執(zhí)行的任務(wù)（用 task，添加頭文件 hls_task.h)，同時(shí)可并行執(zhí)行的 task 接口（對(duì)應(yīng) C++ 函...

2023-08-11 標(biāo)簽：amd Verilog 函數(shù) 1.1k 0

在X86處理器上跑嵌入式應(yīng)用程序的Software Emulation

在 Vitis 流程中，編譯的目標(biāo)分為軟件仿真(software emultion)，硬件仿真(hardware emulation)以及硬件(hard...

2023-08-09 標(biāo)簽：處理器嵌入式 Xilinx 1.6k 0

使用VVAS調(diào)用HLS生成硬件加速器的主要流程

本篇博客介紹 VVAS 框架所支持調(diào)用的 H/W(HLS) 內(nèi)核。 H/W 內(nèi)核指的是使用 HLS 工具生成的在 FPGA 部分執(zhí)行的硬件功能模塊。

2023-08-04 標(biāo)簽：fpga amd 內(nèi)核 1.3k 0

使用VVAS開(kāi)發(fā)軟件應(yīng)用

Vitis 視頻分析 SDK 是在 AMD 平臺(tái)上構(gòu)建 AI 驅(qū)動(dòng)的智能視頻分析解決方案的完整軟件棧。它從 USB/MIPI 攝像頭、視頻文件或者 RT...

2023-08-02 標(biāo)簽：amd 接口攝像頭 1.5k 0

《基于“礦板”低成本學(xué)習(xí)Zynq系列》之十-RSA加密程序認(rèn)證

前面我們測(cè)試了DDR，片上memory，片內(nèi)外設(shè)等都OK，也進(jìn)行了跑分，基本可以確認(rèn)SOC沒(méi)問(wèn)題了，我們現(xiàn)在來(lái)測(cè)試下加密。

2023-07-20 標(biāo)簽：DDR soc 程序 2.4k 0

《基于“礦板”低成本學(xué)習(xí)Zynq系列》之九-廉頗老矣否,雖礦也要跑個(gè)分

前面我們測(cè)試了DDR，片上memory，片內(nèi)外設(shè)等都OK，那么現(xiàn)在我們就來(lái)跑個(gè)分看卡你性能怎么樣。

2023-07-20 標(biāo)簽：芯片 DDR 開(kāi)發(fā)板 2k 0

《基于“礦板”低成本學(xué)習(xí)Zynq系列》之八-定時(shí)器等外設(shè)測(cè)試

前面我們測(cè)試了DDR，片上memory，這一篇繼續(xù)測(cè)試片上外設(shè)，定時(shí)器等，以確認(rèn)SOC是否正常。

2023-07-20 標(biāo)簽：DDR soc 定時(shí)器 1.6k 0

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本文轉(zhuǎn)自公眾號(hào)歡迎關(guān)注《基于“礦板”低成本學(xué)習(xí)Zynq系列》之四-第一個(gè)工程HelloWorld一下 (qq.com) 一.前言前面我們了解了板子的...

2023-07-19 標(biāo)簽：soc 程序開(kāi)發(fā)板 4.8k 1

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電子發(fā)燒友網(wǎng)于2006年10月成立，是一個(gè)以電子技術(shù)知識(shí)為核心，以工程師為主導(dǎo)的平臺(tái)。致立于為中國(guó)電子工程師的電子產(chǎn)品設(shè)計(jì)等做出最大貢獻(xiàn)，促進(jìn)中國(guó)電子科技的穩(wěn)步發(fā)展。
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　Vcc和Vdd是器件的電源端。Vcc是雙極器件的正，Vdd多半是單極器件的正。下標(biāo)可以理解為NPN晶體管的集電極C，和PMOS or NMOS場(chǎng)效應(yīng)管的漏極D。同樣你可在電路圖中看見(jiàn)Vee和Vss，含義一樣。因?yàn)橹髁餍酒Y(jié)構(gòu)是硅NPN所以Vcc通常是正。如果用PNP結(jié)構(gòu)Vcc就為負(fù)了。建議選用芯片時(shí)一定要看清電氣參數(shù)
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