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電子發(fā)燒友網(wǎng)>測(cè)量?jī)x表>采用FPGA芯片和處理器實(shí)現(xiàn)數(shù)字示波器的設(shè)計(jì)

采用FPGA芯片和處理器實(shí)現(xiàn)數(shù)字示波器的設(shè)計(jì)

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處理器及微處理器系統(tǒng)

, GPU)、數(shù)字信號(hào)處理器(Digital Signal Processor)、基帶(Baseband)信號(hào)處理器等。在系統(tǒng)芯片的各個(gè)設(shè)計(jì)(像系統(tǒng)定義、軟硬件劃分、設(shè)計(jì)實(shí)現(xiàn)等)中,集成電路設(shè)計(jì)界一直在考慮
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數(shù)字信號(hào)處理器的特點(diǎn)

,在處理起來(lái)更是高效,所以,非常的使用在便捷設(shè)備當(dāng)中的使用,像是手機(jī)等。DSP經(jīng)常使用能夠同時(shí)獲取多個(gè)數(shù)據(jù)或指令的特殊內(nèi)存架構(gòu)?! ?b class="flag-6" style="color: red">數(shù)字信號(hào)處理器的特點(diǎn)  (1) 軟件可實(shí)現(xiàn)  純粹的模擬信號(hào)處理必須
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2020-02-24 13:52:07

采用FPGA 實(shí)現(xiàn)視頻和圖像處理設(shè)計(jì)

采用FPGA 實(shí)現(xiàn)視頻和圖像處理設(shè)計(jì)
2015-10-26 21:10:06

采用FPGA實(shí)現(xiàn)數(shù)字視頻轉(zhuǎn)換接口設(shè)計(jì)

引言   本文從實(shí)際應(yīng)用的角度出發(fā),采用FPGA作為主控芯片,設(shè)計(jì)了一款數(shù)字視頻接口轉(zhuǎn)換設(shè)備。 該設(shè)備針對(duì)于MT9M111這款數(shù)字圖像傳感產(chǎn)生的ITU-R BT.656格式數(shù)據(jù)進(jìn)行采集、色彩空間
2019-05-05 09:29:33

采用FPGA實(shí)現(xiàn)直接數(shù)字頻率合成器設(shè)計(jì)

如下優(yōu)越性:(1)高性能ACEX 1K器件采用查找表(LUT)和EAB(嵌入式陣列塊)相結(jié)合的結(jié)構(gòu)形式,可實(shí)現(xiàn)復(fù)雜邏輯功能和存儲(chǔ)功能,如通信應(yīng)用中的DSP、多通道數(shù)據(jù)處理、數(shù)據(jù)傳遞和微控制等。(2
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采用FPGA增量式編碼實(shí)現(xiàn)接口設(shè)計(jì)

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采用FPGA來(lái)實(shí)現(xiàn)SVPWM調(diào)制算法

執(zhí)行的處理方式,使得其在高速大規(guī)模的數(shù)據(jù)處理方面有著無(wú)可替代的優(yōu)勢(shì),隨著FPGA工藝和設(shè)計(jì)水平的不斷提高,其在數(shù)字系統(tǒng)中扮演的角色也從邏輯膠合者提升到處理器的核心。FPGA在工業(yè)控制中的應(yīng)用早在十年前
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采用FPGA的協(xié)處理器來(lái)簡(jiǎn)化ASIC仿真

處理器。這些可配置協(xié)處理器可幫助設(shè)計(jì)人員解決傳統(tǒng)ASIC仿真中存在的許多問(wèn)題,并更省力、更快捷地實(shí)現(xiàn)更精確的設(shè)計(jì)。
2019-07-23 06:24:16

采用DSP和FPGA協(xié)處理實(shí)現(xiàn)無(wú)線(xiàn)子系

,最高可提供256 GMAC的DSP性能。將需要高速并行處理的工作卸載給FPGA,而將需要高速串行處理的工作留給處理器,這樣即可在降低系統(tǒng)要求的同時(shí)優(yōu)化整體系統(tǒng)的性?xún)r(jià)比。
2019-07-15 06:18:56

SEP3203處理器實(shí)現(xiàn)FPGA數(shù)據(jù)通信接口設(shè)計(jì)

另一組FTFO的寫(xiě)時(shí)序,實(shí)現(xiàn)了信號(hào)不間斷的采樣和存儲(chǔ)。FPGA將一組數(shù)據(jù)處理完畢后,以中斷的方式通知SEP3203,處理器以DMA方式將運(yùn)算后的結(jié)果存儲(chǔ)到片外的SDRAM中。由于數(shù)據(jù)寫(xiě)滿(mǎn)FIFO的時(shí)間大于
2019-04-26 07:00:06

SEP3203處理器FPGA數(shù)據(jù)通信接口設(shè)計(jì)

和存儲(chǔ)。FPGA將一組數(shù)據(jù)處理完畢后,以中斷的方式通知SEP3203,處理器以DMA方式將運(yùn)算后的結(jié)果存儲(chǔ)到片外的SDRAM中。由于數(shù)據(jù)寫(xiě)滿(mǎn)FIFO的時(shí)間大于FPGA處理數(shù)據(jù)的時(shí)間,所以整個(gè)系統(tǒng)實(shí)現(xiàn)
2018-12-05 10:13:09

FPGA干貨分享六】基于FPGA協(xié)處理器的算法加速的實(shí)現(xiàn)

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FPGA設(shè)計(jì)實(shí)例】基于FPGA數(shù)字示波器設(shè)計(jì)

FPGA數(shù)字示波器。這種特殊的設(shè)計(jì)采用了一個(gè)100MHz的閃速ADC,所以我們正在建立一個(gè)100MSPS(大樣本每秒)示波器。這個(gè)示波器的設(shè)計(jì)很有趣,因?yàn)樗@示了如何強(qiáng)大和實(shí)用的現(xiàn)代FPGA可以
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【TL6748 DSP申請(qǐng)】基于DSP的數(shù)字示波器的研制

相位、多抽樣率處理、級(jí)聯(lián)、易于存儲(chǔ)等;可用于頻率非常低的信號(hào)。項(xiàng)目描述:在借鑒和吸收國(guó)內(nèi)外示波器技術(shù)的基礎(chǔ)上,設(shè)計(jì)了基于DSP的50MHz的數(shù)字示波器。本系統(tǒng)采用了DSP+FPGA的結(jié)構(gòu),充分利用
2015-09-10 11:15:17

【參考書(shū)籍】基于FPGA數(shù)字信號(hào)處理——高亞軍著

`《基于FPGA數(shù)字信號(hào)處理》是一本有關(guān)如何在FPGA實(shí)現(xiàn)數(shù)字信號(hào)處理的著作。本書(shū)以Xilinx高端FPGA作為開(kāi)發(fā)平臺(tái),以數(shù)字信號(hào)處理理論為基礎(chǔ),結(jié)合當(dāng)前的FPGA技術(shù),深入探討了基于FPGA
2012-04-24 09:33:23

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代碼加速和代碼轉(zhuǎn)換到硬件協(xié)處理器的方法如何采用FPGA協(xié)處理器實(shí)現(xiàn)算法加速?
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2019-08-13 07:52:46

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2019-09-18 08:28:47

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2019-08-19 06:15:33

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怎么用FPGA嵌入式處理器實(shí)現(xiàn)您的構(gòu)想?

求大佬分享一下怎么用FPGA嵌入式處理器實(shí)現(xiàn)構(gòu)想?
2021-04-13 06:31:14

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成本低的優(yōu)點(diǎn)提出了一些數(shù)字示波器的虛擬儀器解決方案和嵌入式解決方案,這些設(shè)計(jì)采用FPGA片內(nèi)資源來(lái)實(shí)現(xiàn)數(shù)字示波器的數(shù)據(jù)存儲(chǔ)(RAM)、觸發(fā)控制、數(shù)字信號(hào)運(yùn)算與處理、顯示終端驅(qū)動(dòng)等功能,這在很大程度
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淺析JK-DP50型數(shù)字降噪聲處理器

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2019-07-04 06:03:56

用DSP Builder設(shè)計(jì)基于PLD的數(shù)字信號(hào)處理器

的修改方面缺乏靈活性。本文介紹一種嶄新的基于Matlab與QuartusII的DSP處理器的設(shè)計(jì)軟件DSP Builder,詳細(xì)介紹了其設(shè)計(jì)流程與優(yōu)點(diǎn),并以DDS直接數(shù)字合成器的實(shí)現(xiàn)為例說(shuō)明用該軟件來(lái)設(shè)計(jì)DSP處理器的方法以及與Matlab、QuartusÊ之間的關(guān)系。
2011-03-03 10:05:43

級(jí)聯(lián)信號(hào)處理器FPGA實(shí)現(xiàn)方法

和變系數(shù)FIR濾波。常系數(shù)FIR濾波的系數(shù)固定不變,可根據(jù)其特點(diǎn)采用分布式算法進(jìn)行設(shè)計(jì),故實(shí)現(xiàn)起來(lái)速度快,消耗的資源少。變系數(shù)FIR濾波的系數(shù)是不斷變化的。當(dāng)前含有變系數(shù)FIR濾波環(huán)節(jié)的芯片普遍存在速度與處理級(jí)數(shù)的矛盾,有效解決此問(wèn)題具有重要的現(xiàn)實(shí)意義。
2019-07-29 06:08:14

FPGA協(xié)處理器實(shí)現(xiàn)代碼加速的方法有哪些?

當(dāng)今的設(shè)計(jì)工程師受到面積、功率和成本的約束,不能采用GHz級(jí)的計(jì)算機(jī)實(shí)現(xiàn)嵌入式設(shè)計(jì)。在嵌入式系統(tǒng)中,通常是由相對(duì)數(shù)量較少的算法決定最大的運(yùn)算需求。使用設(shè)計(jì)自動(dòng)化工具可以將這些算法快速轉(zhuǎn)換到硬件協(xié)處理器中。然后,協(xié)處理器可以有效地連接到處理器,產(chǎn)生“GHz”級(jí)的性能。
2019-09-03 06:26:27

請(qǐng)問(wèn)FPGA協(xié)處理器有哪些優(yōu)勢(shì)?

請(qǐng)問(wèn)FPGA協(xié)處理器有哪些優(yōu)勢(shì)?
2021-05-08 08:29:13

請(qǐng)問(wèn)數(shù)字示波器怎么采用AD模塊采用液晶實(shí)現(xiàn)波形顯示出來(lái)

數(shù)字示波器 怎么采用AD 模塊采用液晶實(shí)現(xiàn)波形顯示出來(lái)
2018-12-04 15:12:57

選擇哪種FPGA,沒(méi)有處理器

嗨,大家好 我是sandeep,是FPGA的新手。我目前正在開(kāi)發(fā)一個(gè)項(xiàng)目,開(kāi)發(fā)一個(gè)模塊,負(fù)責(zé)處理從PLC接收的數(shù)據(jù)的加密和解密任務(wù)。我需要為沒(méi)有處理器的項(xiàng)目選擇FPGA。那么請(qǐng)你幫我選擇FPGA
2019-05-16 10:20:42

高速專(zhuān)用GFP處理器FPGA實(shí)現(xiàn)

高速專(zhuān)用GFP處理器FPGA實(shí)現(xiàn)采用 實(shí)現(xiàn)了非標(biāo)準(zhǔn)用戶(hù)數(shù)據(jù)接入 網(wǎng)絡(luò)時(shí),進(jìn)行數(shù)據(jù) 封裝和解封裝的處理器電路在處理器電路中引入了緩沖區(qū)管理,使得電路能夠有效處理突發(fā)到達(dá) 瞬時(shí)速率較高的客戶(hù)
2012-08-11 11:51:11

基于單片機(jī)和FPGA的簡(jiǎn)易數(shù)字存儲(chǔ)示波器設(shè)計(jì)

基于單片機(jī)和FPGA的簡(jiǎn)易數(shù)字存儲(chǔ)示波器設(shè)計(jì) l 引言   與傳統(tǒng)模擬示波器相比.數(shù)字存儲(chǔ)示波器不僅具有可存儲(chǔ)波形、體積小、功耗低,使用方便等優(yōu)點(diǎn),而且
2008-12-03 21:55:001159

FPGA嵌入式處理器實(shí)現(xiàn)您的構(gòu)想

FPGA 嵌入式處理器實(shí)現(xiàn)您的構(gòu)想 在采用數(shù)值處理技術(shù)創(chuàng)建嵌入式應(yīng)用時(shí),通常以整數(shù)或定點(diǎn)表示法來(lái)確保算術(shù)運(yùn)算盡量簡(jiǎn)單,這一點(diǎn)至關(guān)重要。因其不僅有助于使成本和
2009-11-05 16:28:48882

VLIW處理器的設(shè)計(jì)與實(shí)現(xiàn)

VLIW處理器的設(shè)計(jì)與實(shí)現(xiàn) 摘要! 介紹了基于FPGA 實(shí)現(xiàn)VLIW微處理器的基本方法# 對(duì)VLIW微處理器具體劃分為C 個(gè) 主要功能模塊$ 依據(jù)FPGA的設(shè)計(jì)思想#采用自頂向下和文本與原理圖相結(jié)合的流水線(xiàn)方式的設(shè)計(jì)方 法# 進(jìn)行VLIW微處理器的5 個(gè)模塊功能設(shè)計(jì)# 從而最終實(shí)現(xiàn)
2011-01-25 19:05:1121

基于FPGA芯片設(shè)計(jì)流處理器MASA-I的實(shí)現(xiàn)

處理器與傳統(tǒng)微處理器相比,具有更高的性能和效率,已廣泛應(yīng)用于圖像處理,媒體處理等領(lǐng)域。本文基于ALTERA EP2S180 FPGA芯片,設(shè)計(jì)并實(shí)現(xiàn)了一款32位異構(gòu)多核流處理器MASA-I。本文對(duì)MASA-I的硬件開(kāi)銷(xiāo)及性能進(jìn)行了評(píng)估,結(jié)果表明,基于流處理的異構(gòu)多核系統(tǒng)能
2011-03-15 12:48:4033

基于FPGA的等效采樣存儲(chǔ)示波器設(shè)計(jì)

提出了一種應(yīng)用于便攜式數(shù)字存儲(chǔ)示波器等效采樣的實(shí)現(xiàn)方案。詳細(xì)講述了FPGA和微處理器LPC2138對(duì)高頻信號(hào)隨機(jī)等效采樣的處理過(guò)程,利用一種全新的方法即主要利用FPGA內(nèi)部邏輯單元完成對(duì)觸發(fā)時(shí)刻到與下一采樣時(shí)刻的時(shí)間間隔的測(cè)量。給出了FPGA對(duì)采樣點(diǎn)的處理
2011-03-16 12:12:35126

基于FPGA和TFT的液晶示波器設(shè)計(jì)

設(shè)計(jì)了以FPGA為核心采集模塊,以單片機(jī)為顯示控制核心,以TFT彩屏液晶為顯示器件的便攜數(shù)字存儲(chǔ)示波器。通過(guò)異步FIFO實(shí)現(xiàn)FPGA中高速數(shù)據(jù)流與單片機(jī)處理速度之間的速率匹配。以三
2011-03-18 16:50:47326

基于FPGA的手持式數(shù)字存儲(chǔ)示波器顯示驅(qū)動(dòng)設(shè)計(jì)

基于FPGA的手持式數(shù)字存儲(chǔ)示波器顯示驅(qū)動(dòng)設(shè)計(jì)通過(guò)對(duì)液晶模塊LTBHB203E1K和FPGA芯片EP1K30QC208-3的研究,利用模塊化的設(shè)計(jì)方法,完成了手持式數(shù)字存儲(chǔ) 示波器 顯示部分的設(shè)計(jì)。給出了利用
2011-07-25 14:44:0059

基于FPGA的嵌入式PLC微處理器設(shè)計(jì)

目前利用FPGA設(shè)計(jì)高性能的嵌入式處理器已經(jīng)成為SOC設(shè)計(jì)的重要部分,對(duì)一種基于FPGA芯片的嵌入式PLC處理器進(jìn)行了研究和設(shè)計(jì),并采用了基于VHDL語(yǔ)言的自頂向下的模塊化設(shè)計(jì)方法,頂層
2011-09-28 18:19:501814

基于單片機(jī)和FPGA數(shù)字示波器的設(shè)計(jì)

提出了一種基于數(shù)字示波器原理,以單片機(jī)和FPGA為控制核心的數(shù)字示波器實(shí)現(xiàn)方法。系統(tǒng)由信號(hào)調(diào)理、程控放大、比較整形和時(shí)鐘產(chǎn)生、采樣控制、測(cè)頻模塊和校準(zhǔn)信號(hào)產(chǎn)生等模塊組成
2011-10-08 15:31:53277

基于FPGA數(shù)字收發(fā)機(jī)信號(hào)處理研究與實(shí)現(xiàn)

本文提出基于FPGA數(shù)字收發(fā)機(jī)信號(hào)處理研究與實(shí)現(xiàn)
2011-11-01 18:20:4250

數(shù)字信號(hào)處理FPGA實(shí)現(xiàn)_劉凌譯

本書(shū)共分8章,主要內(nèi)容包括典型fpga器件的介紹、vhdl硬件描述語(yǔ)言、fpga設(shè)計(jì)中常用軟件簡(jiǎn)介、用fpga實(shí)現(xiàn)數(shù)字信號(hào)處理的數(shù)據(jù)規(guī)劃、多種結(jié)構(gòu)類(lèi)型的fir數(shù)字濾波器的fpga實(shí)現(xiàn)、不同結(jié)構(gòu)
2011-11-04 15:50:120

基于FPGA數(shù)字穩(wěn)定校正單元的實(shí)現(xiàn)

為了實(shí)現(xiàn)對(duì)非相干雷達(dá)的接收相參處理,基于數(shù)字穩(wěn)定校正(DSU)的原理,采用ALTERA公司的StratixⅡ系列芯片和VHDL編程語(yǔ)言,設(shè)計(jì)了一種基于FPGA的DSU硬件實(shí)現(xiàn)方法。實(shí)驗(yàn)結(jié)果表明基于FPGA
2012-06-26 15:48:3627

基于快速傅里葉IP核的數(shù)字脈壓處理器實(shí)現(xiàn)

本文基于快速傅里葉IP核可復(fù)用和重配置的特點(diǎn),實(shí)現(xiàn)一種頻域的FPGA數(shù)字脈壓處理器,能夠完成正交輸入的可變點(diǎn)LFM信號(hào)脈沖壓縮,具有設(shè)計(jì)靈活,調(diào)試方便,可擴(kuò)展性強(qiáng)的特點(diǎn)。
2012-10-15 17:20:462738

嵌入式數(shù)字存儲(chǔ)示波器設(shè)計(jì)

提出了一種基于FPGA和STM32的嵌入式數(shù)字存儲(chǔ)示波器設(shè)計(jì),以STM32為控制核心,FPGA作為數(shù)據(jù)采集和處理模塊,完成了對(duì)外部信號(hào)的采集和傳輸,實(shí)現(xiàn)了存儲(chǔ)示波器數(shù)據(jù)處理和顯示的功能。
2013-02-22 16:28:28162

基于FPGA數(shù)字信號(hào)處理

基于FPGA數(shù)字信號(hào)處理,本文主要探討了基于FPGA數(shù)字信號(hào)處理實(shí)現(xiàn)
2015-10-30 10:39:3830

數(shù)字信號(hào)處理FPGA實(shí)現(xiàn)

本書(shū)比較全面地闡述了fpga數(shù)字信號(hào)處理中的應(yīng)用問(wèn)題。本書(shū)共分8章,主要內(nèi)容包括典型fpga器件的介紹、vhdl硬件描述語(yǔ)言、fpga設(shè)計(jì)中常用軟件簡(jiǎn)介、用fpga實(shí)現(xiàn)數(shù)字信號(hào)處理的數(shù)據(jù)規(guī)劃、多種
2015-12-23 11:07:4644

基于FPGA的FFT信號(hào)處理器的設(shè)計(jì)與實(shí)現(xiàn)

本文主要研究如何利用FPGA實(shí)現(xiàn)FFl’算法,研制具有自主知識(shí)產(chǎn)權(quán)的FFT 信號(hào)處理器
2016-03-21 16:22:5240

高速專(zhuān)用GFP處理器FPGA實(shí)現(xiàn)

高速專(zhuān)用GFP處理器FPGA實(shí)現(xiàn),下來(lái)看看
2016-05-10 11:24:3315

華清遠(yuǎn)見(jiàn)FPGA代碼-基于NIOSII處理器數(shù)字鐘設(shè)計(jì)

華清遠(yuǎn)見(jiàn)FPGA代碼-基于NIOSII處理器數(shù)字鐘設(shè)計(jì)
2016-10-27 18:07:5414

數(shù)字信號(hào)處理FPGA實(shí)現(xiàn)

數(shù)字信號(hào)處理FPGA實(shí)現(xiàn)
2016-12-14 22:08:2532

基于FPGA數(shù)字存儲(chǔ)示波器的顯示技術(shù)

基于FPGA數(shù)字存儲(chǔ)示波器的顯示技術(shù)
2017-01-18 20:35:0935

基于FPGA數(shù)字存儲(chǔ)示波器設(shè)計(jì)與實(shí)現(xiàn)

FPGA)作為數(shù)字存儲(chǔ)示波器采樣控制系統(tǒng)的核心,從芯片間有效協(xié)助的角度,基于FPGA 設(shè)計(jì)ARM 接[ ]通信控制模塊和外圍芯片驅(qū)動(dòng)功能模塊,以FPGA 為核心有效地組織其它芯片,共同完成數(shù)字存儲(chǔ)示波器數(shù)據(jù)采樣過(guò)程,確保數(shù)據(jù)按需
2017-10-18 15:15:5246

數(shù)字存儲(chǔ)示波器對(duì)外圍芯片的控制設(shè)計(jì)

FPGA)作為數(shù)字存儲(chǔ)示波器采樣控制系統(tǒng)的核心,從芯片間有效協(xié)助的角度,基于 FPGA設(shè)計(jì) ARM 接口通信控制模塊和外圍芯片驅(qū)動(dòng)功能模塊,以 FPGA 為核心有效地組織其它芯片,共同完成數(shù)字存儲(chǔ)示波器數(shù)據(jù)采樣過(guò)程,確保數(shù)據(jù)按需求
2017-10-19 16:05:2812

Builder數(shù)字信號(hào)處理器FPGA設(shè)計(jì)

DSP技術(shù)廣泛應(yīng)用于各個(gè)領(lǐng)域,但傳統(tǒng)的數(shù)字信號(hào)處理器由于以順序方式工作使得數(shù)據(jù)處理速度較低,且在功能重構(gòu)及應(yīng)用目標(biāo)的修改方面缺乏靈活性。而使用具有并行處理特性的FPGA實(shí)現(xiàn)數(shù)字信號(hào)處理系統(tǒng),具有很強(qiáng)
2017-10-31 10:37:230

低成本的采用FPGA實(shí)現(xiàn)SDH設(shè)備時(shí)鐘芯片技術(shù)

介紹一種采用FPGA(現(xiàn)場(chǎng)可編程門(mén)陣列電路)實(shí)現(xiàn)SDH(同步數(shù)字體系)設(shè)備時(shí)鐘芯片設(shè)計(jì)技術(shù),硬件主要由1 個(gè)FPGA 和1 個(gè)高精度溫補(bǔ)時(shí)鐘組成.通過(guò)該技術(shù),可以在FPGA實(shí)現(xiàn)需要專(zhuān)用芯片才能實(shí)現(xiàn)的時(shí)鐘芯片各種功能,而且輸入時(shí)鐘數(shù)量對(duì)比專(zhuān)用芯片更加靈活,實(shí)現(xiàn)該功能的成本降低三分之一.
2017-11-21 09:59:001840

基于FPGA的NoC多核處理器的設(shè)計(jì)

為了能夠靈活地驗(yàn)證和實(shí)現(xiàn)自主設(shè)計(jì)的基于NoC的多核處理器,縮短N(yùn)oC多核處理器的設(shè)計(jì)周期,提出了設(shè)計(jì)集成4片Virtex-6—550T FPGA的NoC多核處理器原型芯片設(shè)計(jì)/驗(yàn)證平臺(tái)。分析和評(píng)估
2017-11-22 09:15:014137

采用FPGA芯片實(shí)現(xiàn)FFT處理器的設(shè)計(jì)

、遙感遙測(cè)、地質(zhì)勘探、航空航天、生物醫(yī)學(xué)等眾多領(lǐng)域都獲得極其廣泛的應(yīng)用。隨著FPGA技術(shù)的高速發(fā)展以及EDA技術(shù)的成熟,采用FPGA芯片實(shí)現(xiàn)FFT已經(jīng)顯示出巨大的潛力。
2019-01-15 10:20:002757

如何使用FPGA實(shí)現(xiàn)高速專(zhuān)用GFP處理器

采用FPGA實(shí)現(xiàn)了非標(biāo)準(zhǔn)用戶(hù)數(shù)據(jù)接入sDH網(wǎng)絡(luò)時(shí),進(jìn)行數(shù)據(jù)GFP封裝和解封裝的處理器電路。在處理器電路中引入了緩沖區(qū)管理器,使得電路能夠有效處理突發(fā)到達(dá)、瞬時(shí)速率較高的客戶(hù)數(shù)據(jù);采用了并行cRc算法
2021-01-27 16:38:037

如何使用FPGA實(shí)現(xiàn)高速專(zhuān)用的GFP處理器

采用FPGA實(shí)現(xiàn)了非標(biāo)準(zhǔn)用戶(hù)數(shù)據(jù)接入sDH網(wǎng)絡(luò)時(shí),進(jìn)行數(shù)據(jù)GFP封裝和解封裝的處理器電路。在處理器電路中引入了緩沖區(qū)管理器,使得電路能夠有效處理突發(fā)到達(dá)、瞬時(shí)速率較高的客戶(hù)數(shù)據(jù);采用了并行cRc算法
2021-01-28 17:22:527

如何使用FPGA實(shí)現(xiàn)數(shù)字信號(hào)處理算法的研究

現(xiàn)代數(shù)字信號(hào)處理對(duì)實(shí)時(shí)性提出了很高的要求,當(dāng)最快的數(shù)字信號(hào)處理器(DSP)仍無(wú)法達(dá)到速度要求時(shí),唯一的選擇是增加處理器的數(shù)目,或采用客戶(hù)定制的門(mén)陣列產(chǎn)品。隨著可編程邏輯器件技術(shù)的發(fā)展,具有強(qiáng)大并行
2021-02-01 16:11:0016

如何使用FPGA實(shí)現(xiàn)順序形態(tài)圖像處理器的硬件實(shí)現(xiàn)

該文在闡述了灰度圖像順序形態(tài)變換的基礎(chǔ)上,介紹了順序形態(tài)變換硬件實(shí)現(xiàn)的圖像處理系統(tǒng).該系統(tǒng)采用DSP+FPGA的框架結(jié)構(gòu),利用FPGA的可重構(gòu)特性將其中一片FPGA作為協(xié)處理器可以實(shí)現(xiàn)不同的圖像處理
2021-04-01 11:21:468

采用FPGA協(xié)處理器實(shí)現(xiàn)算法加速教程

當(dāng)今的設(shè)計(jì)工程師受到面積、功率和成本的約束,不能采用GHz級(jí)的計(jì)算機(jī)實(shí)現(xiàn)嵌入式設(shè)計(jì)。在嵌入式系統(tǒng)中,通常是由相對(duì)數(shù)量較少的算法決定最大的運(yùn)算需求。使用設(shè)計(jì)自動(dòng)化工具可以將這些算法快速轉(zhuǎn)換到硬件
2021-09-28 10:38:043585

數(shù)字信號(hào)處理FPGA實(shí)現(xiàn).第3版英文

數(shù)字信號(hào)處理FPGA實(shí)現(xiàn).第3版英文
2021-10-18 10:55:320

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