在一個(gè)環(huán)境中實(shí)現(xiàn)實(shí)現(xiàn)FPGA地點(diǎn)和路線封裝設(shè)計(jì)
在一個(gè)環(huán)境中實(shí)現(xiàn)從合成到封裝位置和路由，以及位流生成的整個(gè)fpga設(shè)計(jì)。常見的選項(xiàng)是運(yùn)行時(shí)和路由都內(nèi)置到接口中，并且報(bào)表是位于同一位置的組合結(jié)果。
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