最近完成了Arria10的原理圖設(shè)計(jì)，想做一些記錄，下面是關(guān)于FPGA配置的一些方式。

MSEL

將 MSEL 管腳直接連接到VCCPGM 或 GND，不需使用任何的上拉或下拉電阻，即可選擇出所需的

配置方案

? 不要通過微處理器或其他器件驅(qū)動(dòng) MSEL 管腳。

? 對(duì)“通過 HPS 的配置”（Configurationvia HPS）使用 PS 或 FPP MSEL 管腳設(shè)置。

三種主要的配置方式

1、主動(dòng)配置方式（AS)

2、被動(dòng)配置方式（PS)

3、JTAG方式

1、AS模式(active serial configuration mode)：FPGA器件每次上電時(shí)作為控制器，由FPGA器件引導(dǎo)配置操作過程，它控制著外部存儲(chǔ)器和初始化過程，對(duì)配置器件EPCS主動(dòng)發(fā)出讀取數(shù)據(jù)信號(hào)，從而把EPCS的數(shù)據(jù)讀入FPGA中，實(shí)現(xiàn)對(duì)FPGA的編程配置數(shù)據(jù)通過DATA0引腳送入FPGA，配置數(shù)據(jù)被同步在DCLK輸入上，1個(gè)時(shí)鐘周期傳送1位或者數(shù)據(jù)。AS是燒到FPGA的配置芯片里保存的，每次上電就寫到FPGA里。

（1）AS programming interface

當(dāng)編程 EPCQ-L 器件時(shí)，下載電纜通過驅(qū)動(dòng) nCE 管腳為高電平而禁用對(duì) AS 接口的訪問。nCONFIG線也被拉低以保持 Arria 10 器件處于復(fù)位階段。編程完成后，下載電纜釋放 nCE 和 nCONFIG，從而使得 下拉和 上拉電阻能夠分別驅(qū)動(dòng) GND 和 VCCPGM 的管腳。使用下載電纜進(jìn)行 EPCQ-L 編程期間，DATA0 將編程數(shù)據(jù)、操作指令和地址信息從下載電纜傳輸?shù)?EPCQ-L。使用下載電纜進(jìn)行 EPCQ-L 驗(yàn)證期間，DATA1 將編程數(shù)據(jù)返回到下載電纜。

（2）JTAG interface

使用 AS 編程接口時(shí), 配置數(shù)據(jù)通過 Quartus Prime 或任何支持的第三方軟件被編程到 EPCQ-L。使用 JTAG 接口時(shí)，稱為 SFL IP core 的 Altera IP 必須被下載到 Arria 10 器件以形成 JTAG 接口和 EPCQ-L 之間的橋接。這樣就能夠使用 JTAG 接口直接編程 EPCQ-L。這種方式的燒寫文件是.JIC。

2、JTAG模式

JTAG：JTAG是直接配置到FPGA里面的，由于是SRAM，斷電后要重?zé)?；JTAG燒寫的時(shí)SRAM對(duì)象文件（.sof）

JTAG配置的時(shí)間只與目標(biāo)芯片的型號(hào)有關(guān)，而與具體應(yīng)用無關(guān)。

JTAG Configuration of a Single Device Using a Download Cable

JTAG Configuration of a Single Device Using a Microprocessor

對(duì)于這種連接方式，是把數(shù)據(jù)寫入到存儲(chǔ)器中，每次上電時(shí)由控制器去配置FPGA。

3、被動(dòng)配置方式（PS）

PS模式(passive serial configuration mode)：由外部計(jì)算機(jī)或控制器讀取外部存儲(chǔ)器的配置數(shù)據(jù)寫入到FPGA的配置過程?？刂婆渲眠^程的操作是在外部處理器上實(shí)現(xiàn)的，對(duì)于MAX V和MAX II可以通過PFL IP來實(shí)現(xiàn)這個(gè)過程，對(duì)于PC主機(jī)可以通過下載線來實(shí)現(xiàn)該過程。被動(dòng)配置模式又分為串行被動(dòng)模式和并行被動(dòng)模式。該模式可以實(shí)現(xiàn)對(duì)FPGA在線可編程。

Single Device PS Configuration Using an External Host

Single Device PS Configuration Using an Intel FPGA Download Cable

這種方式我是沒有實(shí)現(xiàn)過的，所以了解的可能不是很正確。

原文標(biāo)題：FPGA配置的三種主要方式

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