全加器的真值表
全加器英語名稱為full-adder，是用門電路實現(xiàn)兩個二進(jìn)制數(shù)相加并求出和的組合線路，稱為一位全加器。一位全加器可以處理低位進(jìn)位，并輸出本位加法進(jìn)位，多個一位全加器進(jìn)行級聯(lián)可以得到多位。
全加器是形成三位算術(shù)和的組合電路，它由三個輸入和兩個輸出組成。
真值表
a.) 基于真值表，S 和 C 的卡諾圖如下：
S 和 C 的 K 映射
b.) S 輸出可以減少為：
進(jìn)位輸出 C 為：
全加器的簡化電路
邏輯電路變成了兩個級聯(lián)的半加器和一個或門。
文章來源：eeweb avon ampo
編輯：ymf
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