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如何尋找時(shí)序路徑的起點(diǎn)與終點(diǎn)

FPGA技術(shù)江湖 ? 來源:FPGA技術(shù)江湖 ? 作者:FPGA技術(shù)江湖 ? 2022-05-04 17:13 ? 次閱讀
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今天看《集成電路時(shí)序分析與建模》中看到這么一個(gè)知識(shí)點(diǎn),覺得有點(diǎn)意思,就記錄下來,與大家一起分享。

先看 如下電路圖:

ca813046-c471-11ec-bce3-dac502259ad0.jpg

左邊的電路圖是需要分析的電路,我們的目的是要對(duì)此電路進(jìn)行時(shí)序分析,那首先要找到該電路需要分析的時(shí)序路徑,既然找路徑,那找到時(shí)序分析的起點(diǎn)與終點(diǎn)即可。

尋找時(shí)序路徑的起點(diǎn)和終點(diǎn)的原則如下:

起點(diǎn):

設(shè)計(jì)邊界的數(shù)據(jù)輸入端口信號(hào)輸入端口;如上圖右邊的I0,I1;

時(shí)序元件(一般指DFF)的輸出,例如上圖右邊的11,13,15;

存儲(chǔ)單元的數(shù)據(jù)輸出,其實(shí)這和第2條一致,時(shí)序單元也是存儲(chǔ)單元,例如DFF,但這里的存儲(chǔ)單元一般指存儲(chǔ)器,例如RAM等;

終點(diǎn):

時(shí)序單元的數(shù)據(jù)輸入,例如上圖右邊的10,12,14;

存儲(chǔ)單元的數(shù)據(jù)輸入,類似于時(shí)序單元,但更多指存儲(chǔ)器等,例如RAM等;

設(shè)計(jì)邊界的輸出Q0,Q1,Q2;

根據(jù)上述原則即可得到,時(shí)序分析的起點(diǎn)(最左邊)和終點(diǎn)(最右邊):

ca955de6-c471-11ec-bce3-dac502259ad0.jpg

時(shí)序路徑

中間經(jīng)過的節(jié)點(diǎn)都可認(rèn)為是延遲單元。

實(shí)際進(jìn)行時(shí)序分析時(shí),可不必每次都這么轉(zhuǎn)換,但是不得不說,這種理論化的方式可以讓你的分析更具理論支撐,見多了熟悉了之后便可更快速的識(shí)別時(shí)序路徑。這是分析的第一步,祝入門快樂。

審核編輯 :李倩

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原文標(biāo)題:【靜態(tài)時(shí)序分析】如何尋找時(shí)序路徑的起點(diǎn)與終點(diǎn)

文章出處:【微信號(hào):HXSLH1010101010,微信公眾號(hào):FPGA技術(shù)江湖】歡迎添加關(guān)注!文章轉(zhuǎn)載請(qǐng)注明出處。

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