易靈思Ti180報錯分析cannot connect to more than 4 different clocks per region on left and right
報錯：cannot connect to more than 4 different clocks per region on left and right
今天在Ti180分配LVDS的時候出現(xiàn)了這個錯誤。原因是在pinout文件中對應的Clock Region中，不能超過4個時鐘去驅動。
也就是GPIOR_PN_42,41,40三組差分對，不能由兩組LVDS來驅動，因為每組LVDS時鐘有l(wèi)vds_fast_clk和lvds_slow_clk兩個，兩組就會有4個時鐘在Region clock R13區(qū)域。
| Emulated MIPI RX Function | LVDS and MIPI Pairs | Clock Region |
| RX_DATA_P1_I6 | GPIOR_PN_42 | R13 |
| RX_DATA_N1_I6 | GPIOR_PN_42 | R13 |
| RX_DATA_N0_I6 | GPIOR_PN_41 | R13 |
| RX_DATA_P0_I6 | GPIOR_PN_41 | R13 |
| RX_DATA_N7_I7 | GPIOR_PN_40 | R13 |
| RX_DATA_P7_I7 | GPIOR_PN_40 | R13 |
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發(fā)表于 10-11 07:18
工商網監(jiān)
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