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《RVfpga:理解計算機體系結構》3.0 版本更新上線

穎脈Imgtec ? 2024-01-18 08:27 ? 次閱讀
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《RVfpga:理解計算機體系結構》(以下簡稱“《RVfpga》”)是Imagination推出的完整RISC-V計算機體系結構課程,該課程針對本科教學設計,包含一整套豐富的教學資料和實踐練習,可幫助學生了解處理器架構中的關鍵要素,包括多個IP 內(nèi)核,修改RISC-V 內(nèi)核的方法,以及IP 內(nèi)核的微架構。

2020年4月我們發(fā)布了《RVfpga》中文版1.0,2022年5月《RVfpga》中文版2.0 上線,此次是《RVfpga》3.0 版本。新的部分基于 VeeR EL2 核心,相比之前使用的 EH1 更為精簡。這使得原始的練習可以在成本較低的FPGA平臺上運行,如 Digilent 的 Basys3 和 Real Digital 的“Boolean Board”。許多大學的實驗室以及學生和愛好者已經(jīng)擁有這些開發(fā)板,因此更多用戶可以通過《RVfpga》學習計算機體系結構。此外,《RVfpga》3.0 還添加了對 Imagination 擁有的 IDE - Catapult SDK 的支持,同時也支持 PlatformIO。

《RVfpga》3.0 更新細節(jié):

添加對 VeeR EL2 的支持,該核比 VeeR EH1 更為精簡。基于 VeeR EH1 核和 VeeRwolf SoC 的課程材料也包含在此版本中。

增加對低成本開發(fā)板的支持,如 Real Digital 的 Boolean Board 和 Digilent 的 Basys 3 Board。添加對新的仿真工具的支持:RVfpga-ViDBo("Virtual Development Board虛擬開發(fā)開發(fā)板")和 RVfpga-Pipeline。為每個新增配置(Basys3 和 Boolean Boards,以及原始的 Nexys A7/Nexys 4 Boards,包括使用和不使用 DDR 存儲器的情況)添加入門指南和實驗室。添加對 Catapult SDK 的支持(僅限于 VeeR EL2)。創(chuàng)建了一個安裝了所有工具且已準備好使用的 Ubuntu 22.04 虛擬機(下載需要14GB 內(nèi)存 )。

聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權轉載。文章觀點僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學習之用,如有內(nèi)容侵權或者其他違規(guī)問題,請聯(lián)系本站處理。 舉報投訴
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