; 8; ++var) {
rt_mutex_take(lock[var], RT_WAITING_FOREVER);
if(sock[var] != server_cfg_num &
發(fā)表于 09-29 06:41
LPBAM的一個庫接口返回錯誤導(dǎo)致出錯,我通過反復(fù)對比,使用舊代碼工程沒問題,只要聽從提示更新代碼庫后重新生成就出現(xiàn)此問題,測試期間代碼并無改動。
發(fā)表于 04-23 07:51
惠普電腦電源D10一240P2A芯片型不知道如何查到它的型號
發(fā)表于 04-19 12:54
Micro-Lock Plus連接器系列專為緊湊型應(yīng)用打造,不僅具備高溫環(huán)境下所需的電氣和機(jī)械可靠性,還提供出色的空間優(yōu)化與堅固耐用的連接性能。該系列產(chǎn)品能滿足各行業(yè)的嚴(yán)格需求,包括在嚴(yán)苛環(huán)境下運(yùn)行設(shè)備的要求。
發(fā)表于 03-17 15:11
?1227次閱讀
嘗試過讀取0x0,可以讀到第一個cvbs lock 狀態(tài)。其它三個輸入端口如何讀取其Lost lock status?
發(fā)表于 01-22 06:43
需求:在視頻輸入處,想要檢測攝像頭連接情況。如果連接不正常,給出告警或其他處理。
方案:從tvp5151的手冊來看,有如下寄存器,僅找到這部分內(nèi)容,其他內(nèi)容尚未找到。
疑問:是否可以將lost lock detect作為與攝像頭連接狀態(tài)的檢測?
謝謝。:)
發(fā)表于 01-10 08:37
最近在調(diào)試AD模塊,使用ADC12D1800,AD輸出的時鐘DCLKI、DCLKQ首先經(jīng)過FPGA內(nèi)部的PLL用于寄存數(shù)據(jù),但是PLL的LOCK信號不能鎖定,出現(xiàn)低電平,請問最可能是什么原因?
發(fā)表于 01-01 07:58
我在高通msm8909平臺使用sn65dsi83這顆IC,在寫完寄存器參數(shù),PLL_LOCK后,讀取0xE5的值為0x31,enable IC 的 SW_IRQ,打開視頻數(shù)據(jù)后,會不停地報中斷,讀取到的0xE5的值為0x01,
發(fā)表于 12-20 11:18
DS90UB954A RIN1 有時候無法Lock 913輸入的FPD-link信號。但是從物理上可以在954輸入端可以量到信號。MIPI端無輸出信號。
這種狀態(tài)下0x4D 低兩位一直為0x40。
發(fā)表于 12-17 08:36
在使用過程中出現(xiàn)DS90UB954出錯后就不能繼續(xù)收圖現(xiàn)象. 出錯時候0x4D提示:[0x4D] : 0x30 或者是0x33
手冊提示是:
Bi-directional Contr
發(fā)表于 12-16 08:27
現(xiàn)通過914配置913:
1)直接讀取914的0x06,可自動獲取913的地址0xB0
2)配置SER_Alias地址0x07,寫入別名0xB2
3)讀取0xB2的0x00地址,無法獲取
4)測量lock腳,一直為低,有試過將bist打高,lock一直沒變化
請問下問題
發(fā)表于 12-12 07:39
想請問一下LMH1983的0x1C Loss of Lock Threshold 和0x2D LockStepSize的具體功能。 LockStepSize似乎是設(shè)置一個觀察時間,Loss
發(fā)表于 11-12 07:23
我們使用LMK04821芯片的單PLL模式,從OSCin輸入125Mhz的差分時鐘,配置參數(shù)如下。
測試中發(fā)現(xiàn),輸出的時鐘頻率基本上是對的,但PLL2不能lock。
請問可能是什么原因?需要如何調(diào)查和解決這個問題?謝謝!
發(fā)表于 11-11 06:13
684.4536m
注:在使用CDCE62005 EVM工具配置5路LVDS 100MHz和200MHz輸出時,LOCK信號能正常拉高,在測試5路128MHz和150MHz時出現(xiàn)上述問題。
發(fā)表于 11-08 12:26
采用AUX_IN輸入25MHz時鐘,外部配置引腳如圖均設(shè)為高電平(經(jīng)測量確為高電平),芯片寄存器為默認(rèn),希望能實現(xiàn)芯片手冊示例中的輸出(156.25MHz和125MHz等輸出)。
經(jīng)測量芯片供電正常,輸入時鐘正確給入,但都無輸出,且PLL_LOCK始終為低電平。求問可能是出了什么問題?
發(fā)表于 11-08 07:07
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